參數(shù)資料
型號： INTEL82801
廠商： Intel Corp.
英文描述： 82801AB (ICH0) I/O Controller Hub
中文描述： 82801AB（ICH0）I / O控制器集線器
文件頁數(shù)： 73/414頁
文件大小： 2140K
代理商： INTEL82801
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82801AA and 82801AB Datasheet
5-23
Functional Description
5.7
8259 Interrupt Controllers (PIC) (D31:F0)
The ICH incorporates the functionality of two 8259 interrupt controllers that provide system
interrupts for the ISA compatible interrupts. These interrupts are: system timer, keyboard
controller, serial ports, parallel ports, floppy disk, IDE, mouse, and DMA channels. In addition,
this interrupt controller can support the PCI based interrupts, by mapping the PCI interrupt onto the
compatible ISA interrupt line. Each 8259 core supports 8 interrupts, numbered 0 - 7.
Table 5-13
shows how the cores are connected
.
The ICH cascades the slave controller onto the master controller through master controller
interrupt input 2. This means there are only 15 possible interrupts for the ICH PIC. Interrupts can
individually be programmed to be edge or level, except for IRQ0, IRQ2, IRQ8#, and IRQ13.
Note:
Previous devices internally latched IRQ12 and IRQ1 and required a port 60h read to clear the latch.
The ICH can be programmed to latch IRQ12 or IRQ1 (see bit 11 and bit 12 in General Control
Register,
Section 8.1.21
).
5.7.1
Interrupt Handling
Generating Interrupts
The PIC interrupt sequence involves three bits, from the IRR, ISR, and IMR, for each interrupt
level. These bits are used to determine the interrupt vector returned, and status of any other pending
interrupts.
Table 5-14
defines the IRR, ISR and IMR.
Table 5-13. Interrupt Controller Core Connections
8259
8259
Input
Typical Interrupt
Source
Connected Pin / Function
Master
0
Internal
Internal Timer / Counter 0 output
1
Keyboard
IRQ1 via SERIRQ
2
Internal
Slave Controller INTR output
3
Serial Port A
IRQ3 via SERIRQ
4
Serial Port B
IRQ4 via SERIRQ
5
Parallel Port / Generic
IRQ5 via SERIRQ
6
Floppy Disk
IRQ6 via SERIRQ
7
Parallel Port / Generic
IRQ7 via SERIRQ
Slave
0
Internal Real Time Clock
Internal RTC
1
Generic
IRQ9 via SERIRQ
2
Generic
IRQ10 via SERIRQ
3
Generic
IRQ11 via SERIRQ
4
PS/2 Mouse
IRQ12 via SERIRQ
5
Internal
State Machine output based on processor FERR#
assertion.
6
Primary IDE cable
IRQ14 from input signal or via SERIRQ
7
Secondary IDE Cable
IRQ15 from input signal or via SERIRQ
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