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參數(shù)資料
| 型號： | INTEL82801 |
| 廠商： | Intel Corp. |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | 82801AB（ICH0）I / O控制器集線器 |
| 文件頁數(shù)： | 183/414頁 |
| 文件大小： | 2140K |
| 代理商： | INTEL82801 |
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82801AA and 82801AB ICH Datasheet
7-7
Hub Interface-to-PCI Bridge Registers (D30:F0)
7.1.13
SMLT—Secondary Master Latency Timer Register
(HUB-PCI—D30:F0)
Offset Address:
Default Value:
1Bh
00h
Attribute:
Size:
R/W
8 bits
This Master Latency Timer (MLT) controls the amount of time that the ICH will continue to burst
data as a master on the PCI bus. When the ICH starts the cycle after being granted the bus, the
counter is loaded and starts counting down from the assertion of FRAME#. If the internal grant to
this device is removed, then the expiration of the MLT counter will result in the deassertion of
FRAME#. If the internal grant has not been removed, then the ICH can continue to own the bus.
7.1.14
IOBASE—I/O Base Register (HUB-PCI—D30:F0)
Offset Address:
Default Value:
1Ch
F0h
Attribute:
Size:
R/W
8 bits
7.1.15
IOLIM—I/O Limit Register (HUB-PCI—D30:F0)
Offset Address:
Default Value:
1Dh
00h
Attribute:
Size:
R/W
8 bits
Bit
Description
7:3
Master Latency Count.
5-bit value that indicates the number of PCI clocks, in 8-clock increments,
that the ICH will remain as master of the bus.
2:0
Reserved.
Bit
Description
7:4
I/O Address Base bits [15:12]—R/W.
I/O Base bits corresponding to address lines 15:12 for 4 KB
alignment. Bits 11:0 are assumed to be padded to 000h.
3:0
I/O Addressing Capability—RO.
This is hardwired to 0h, indicating that the hub interface to PCI
bridge does not support 32-bit I/O addressing. This means that the I/O base & limit upper address
registers must be read only.
Bit
Description
7:4
I/O Address Limit bits [15:12]—R/W.
I/O Base bits corresponding to address lines 15:12 for 4 KB
alignment. Bits 11:0 are assumed to be padded to FFFh.
3:0
I/O Addressing Capability—RO.
This is hardwired to 0h, indicating that the hub interface to PCI
bridge does not support 32-bit I/O addressing. This means that the I/O base & limit upper address
registers must be read only.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| INTEL82802AB | Firmware Hub (FWH) |
| INTELDX2 | High-Performance 32-Bit Embedded Processor(高性能32位嵌入式處理器) |
| INTELDX4 | Embedded Write-Back Enhanced Processor(32位回復(fù)嵌入式增強型處理器) |
| IPS54511 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
| IPS5451 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| INTEL82802AB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Firmware Hub (FWH) |
| INTELLIGENT CHARGER + 4AA | 制造商:Energizer 功能描述:Bulk |
| INTELLI-INCH-LR-STARTER K | 制造商:ALL MOTION 功能描述:Intelli-Inch Stepper & Controller Starter Kit |
| INTELLIPANEL | 制造商:GJD 功能描述:EXTENSION LEAD 8GANG INTELLIPANEL 制造商:GJD 功能描述:EXTENSION LEAD, 8GANG, INTELLIPANEL |
| INTELLIPLUG | 制造商:GLOBAL COMMUNICATIONS 功能描述:ADAPTOR 3WAY INTELLIPLUG |
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