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參數(shù)資料
| 型號(hào)： | INTEL82801 |
| 廠商： | Intel Corp. |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | 82801AB（ICH0）I / O控制器集線器 |
| 文件頁數(shù)： | 7/414頁 |
| 文件大?。?/td> | 2140K |
| 代理商： | INTEL82801 |
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82801AA and 82801AB
Datasheet
vii
5.2
LPC Bridge (with System & Management Functions) (D31:F0)....................5-4
5.2.1
LPC Interface...................................................................................5-4
5.2.1.1
LPC Cycle Types..............................................................5-5
5.2.1.2
Start Field Definition.........................................................5-5
5.2.1.3
Cycle Type / Direction (CYCTYPE + DIR)........................5-6
5.2.1.4
SIZE..................................................................................5-6
5.2.1.5
SYNC................................................................................5-6
5.2.1.6
SYNC Time-out ................................................................5-7
5.2.1.7
SYNC Error Indication......................................................5-7
5.2.1.8
LFRAME# Usage..............................................................5-7
5.2.1.9
I/O Cycles.........................................................................5-9
5.2.1.10 Bus Master Cycles............................................................5-9
5.2.1.11 Configuration and ICH Implications..................................5-9
DMA Operation (D31:F0)..............................................................................5-9
5.3.1
Channel Priority .............................................................................5-10
5.3.2
Address Compatibility Mode ..........................................................5-11
5.3.3
Summary of DMA Transfer Sizes ..................................................5-11
5.3.4
Autoinitialize...................................................................................5-12
5.3.5
Software Commands .....................................................................5-12
PCI DMA.....................................................................................................5-13
5.4.1
PCI DMA Expansion Protocol........................................................5-13
5.4.2
PCI DMA Expansion Cycles ..........................................................5-14
5.4.3
DMA Addresses.............................................................................5-15
5.4.4
DMA Data Generation....................................................................5-15
5.4.5
DMA Byte Enable Generation........................................................5-15
5.4.6
DMA Cycle Termination.................................................................5-16
LPC DMA....................................................................................................5-16
5.5.1
Asserting DMA Requests...............................................................5-16
5.5.2
Abandoning DMA Requests...........................................................5-17
5.5.3
General Flow of DMA Transfers ....................................................5-17
5.5.4
Terminal Count ..............................................................................5-18
5.5.5
Verify Mode....................................................................................5-18
5.5.6
DMA Request Deassertion ............................................................5-18
5.5.7
SYNC Field / LDRQ# Rules...........................................................5-19
8254 Timers (D31:F0).................................................................................5-20
5.6.1
Timer Programming .......................................................................5-20
5.6.2
Reading from the Interval Timer ....................................................5-21
8259 Interrupt Controllers (PIC) (D31:F0)...................................................5-23
5.7.1
Interrupt Handling ..........................................................................5-23
5.7.2
Initialization Command Words (ICWx)...........................................5-25
5.7.3
Operation Command Words (OCW)..............................................5-26
5.7.4
Modes of Operation .......................................................................5-26
5.7.5
Masking Interrupts .........................................................................5-29
5.7.6
Steering PCI Interrupts ..................................................................5-29
Advanced Interrupt Controller (APIC) (D31:F0)..........................................5-30
5.8.1
Interrupt Handling ..........................................................................5-30
5.8.2
Interrupt Mapping...........................................................................5-30
5.8.3
APIC Bus Functional Description...................................................5-31
5.8.3.1
Physical Characteristics of APIC....................................5-31
5.8.3.2
APIC Bus Arbitration.......................................................5-31
5.8.3.3
Bus Message Formats....................................................5-32
5.3
5.4
5.5
5.6
5.7
5.8
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| INTEL82802AB | Firmware Hub (FWH) |
| INTELDX2 | High-Performance 32-Bit Embedded Processor(高性能32位嵌入式處理器) |
| INTELDX4 | Embedded Write-Back Enhanced Processor(32位回復(fù)嵌入式增強(qiáng)型處理器) |
| IPS54511 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
| IPS5451 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| INTEL82802AB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Firmware Hub (FWH) |
| INTELLIGENT CHARGER + 4AA | 制造商:Energizer 功能描述:Bulk |
| INTELLI-INCH-LR-STARTER K | 制造商:ALL MOTION 功能描述:Intelli-Inch Stepper & Controller Starter Kit |
| INTELLIPANEL | 制造商:GJD 功能描述:EXTENSION LEAD 8GANG INTELLIPANEL 制造商:GJD 功能描述:EXTENSION LEAD, 8GANG, INTELLIPANEL |
| INTELLIPLUG | 制造商:GLOBAL COMMUNICATIONS 功能描述:ADAPTOR 3WAY INTELLIPLUG |
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