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參數(shù)資料
| 型號(hào)： | INTEL82801 |
| 廠商： | Intel Corp. |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | 82801AB（ICH0）I / O控制器集線器 |
| 文件頁(yè)數(shù)： | 327/414頁(yè) |
| 文件大?。?/td> | 2140K |
| 代理商： | INTEL82801 |
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82801AA and 82801AB Datasheet
12-15
AC’97 Audio Controller Registers (D31:F5)
15
Read Completion Status:
This bit indicates the status of codec read completions.
1 = A codec read results in a time-out. The bit remains set until being cleared by software.
0 = A codec read completes normally.
14
Bit 3 of slot 12
: Display bit 3 of the most recent slot 12. This bit is Read Only.
13
Bit 2 of slot 12
: Display bit 2 of the most recent slot 12. This bit is Read Only.
12
Bit 1 of slot 12
: Display bit 1 of the most recent slot 12. This bit is Read Only.
11
Secondary Resume Interrupt.
This bit indicates that a resume event occurred on AC_SDIN[1].
1 = Resume event occurred
0 = Cleared by writing a 1 to this bit position.
10
Primary Resume Interrupt.
This bit indicates that a resume event occurred on AC_SDIN[0].
1 = Resume event occurred
0 = Cleared by writing a 1 to this bit position.
9
Secondary Codec Ready (SCR).
Reflects the state of the codec ready bit in AC_SDIN[1]. Bus
masters ignore the condition of the codec ready bits. Software must check this bit before starting the
bus masters. Once the codec is “ready”, it must never go “not ready” spontaneously.
8
Primary Codec Ready (PCR).
Reflects the state of the codec ready bit in AC_SDIN [0]. Bus
masters ignore the condition of the codec ready bits. Software must check this bit before starting the
bus masters. Once the codec is “ready”, it must never go “not ready” spontaneously.
7
Mic In Interrupt (MINT).
This bit indicates that one of the Mic in channel interrupts occurred.
1 = Interrupt occurred.
0 = When the specific interrupt is cleared, this bit will be cleared.
6
PCM Out Interrupt (POINT).
This bit indicates that one of the PCM out channel interrupts occurred.
1 = Interrupt occurred.
0 = When the specific interrupt is cleared, this bit will be cleared.
5
PCM In Interrupt (PIINT).
This bit indicates that one of the PCM in channel interrupts occurred.
1 = Interrupt occurred.
0 = When the specific interrupt is cleared, this bit will be cleared.
4:3
Reserved
2
Modem Out Interrupt (MOINT)
. This bit indicates that one of the modem out channel interrupts
occurred.
1 = Interrupt occurred.
0 = When the specific interrupt is cleared, this bit will be cleared.
1
Modem In Interrupt (MIINT)
. This bit indicates that one of the modem in channel interrupts
occurred.
1 = Interrupt occurred.
0 = When the specific interrupt is cleared, this bit will be cleared.
0
GPI Status Change Interrupt (GSCI).
This bit reflects the state of bit 0 in slot 12, and is set
whenever bit 0 of slot 12 is set. This happens when the value of any of the GPIOs currently defined
as inputs changes.
1 = Input changed.
0 = Cleared by writing a 1 to this bit position.
Bit
Description
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