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參數(shù)資料
| 型號： | INTEL82801 |
| 廠商： | Intel Corp. |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | 82801AB（ICH0）I / O控制器集線器 |
| 文件頁數(shù)： | 231/414頁 |
| 文件大?。?/td> | 2140K |
| 代理商： | INTEL82801 |
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82801AA and 82801AB Datasheet
8-41
LPC Interface Bridge Registers (D31:F0)
8.5.6
ARBID—Arbitration ID Register
Index Offset:
Default Value:
02h
00000000h
Attribute:
Size:
RO
32 bits
This register contains the bus arbitration priority for the APIC. This register is loaded whenever the
APIC ID register is loaded. A rotating priority scheme is used for APIC bus arbitration. The winner
of the arbitration becomes the lowest priority agent and assumes an arbitration ID of 0.
a
8.5.7
Redirection Table
Index Offset:
10h
–
11h (vector 0) through
3E
–
3Fh (vector 23)
Bit 16-‘1’, Bits[15:12]=’0’.
All other bits undefined
Attribute:
R/W
Default Value:
Size:
64 bits each, (accessed as
two 32 bit quantities)
The Redirection Table has a dedicated entry for each interrupt input pin. The information in the
Redirection Table is used to translate the interrupt manifestation on the corresponding interrupt pin
into an APIC message.
The APIC will respond to an edge triggered interrupt as long as the interrupt is held until after the
acknowledge cycle has begun. Once the interrupt is detected, a delivery status bit internally to the
I/O APIC is set. The state machine steps ahead and waits for an acknowledgment from the APIC
bus unit that the interrupt message was sent over the APIC bus. Only then is the I/O APIC able to
recognize a new edge on that interrupt pin. That new edge only results in a new invocation of the
handler if its acceptance by the destination APIC causes the Interrupt Request Register bit to go
from 0 to 1. (In other words, if the interrupt was not already pending at the destination.)
Bit
Description
31:28
Reserved.
27:24
I/O APIC Identification.
This 4 bit field contains the I/O APIC Arbitration ID.
23:0
Reserved.
Bit
Description
63:56
Destination.
If bit 11 of this entry is 0 [Physical], then bits [59:56] specifies an APIC ID. If bit 11 of
this entry is 1 [Logical], then bits [63:56] specify the logical destination address of a set of
processors.
55:17
Reserved.
16
Mask.
0 = Not masked: An edge or level on this interrupt pin results in the delivery of the interrupt to the
destination.
1 =
Masked: Interrupts are not delivered nor held pending. Setting this bit after the interrupt is
accepted by a local APIC has no effect on that interrupt. This behavior is identical to the device
withdrawing the interrupt before it is posted to the processor. It is software's responsibility to
deal with the case where the mask bit is set after the interrupt message has been accepted by
a local APIC unit but before the interrupt is dispensed to the processor.
15
Trigger Mode.
This field indicates the type of signal on the interrupt pin that triggers an interrupt.
0 = Indicates edge sensitive
1 = Indicates level sensitive.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| INTEL82802AB | Firmware Hub (FWH) |
| INTELDX2 | High-Performance 32-Bit Embedded Processor(高性能32位嵌入式處理器) |
| INTELDX4 | Embedded Write-Back Enhanced Processor(32位回復(fù)嵌入式增強(qiáng)型處理器) |
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| IPS5451 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| INTEL82802AB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Firmware Hub (FWH) |
| INTELLIGENT CHARGER + 4AA | 制造商:Energizer 功能描述:Bulk |
| INTELLI-INCH-LR-STARTER K | 制造商:ALL MOTION 功能描述:Intelli-Inch Stepper & Controller Starter Kit |
| INTELLIPANEL | 制造商:GJD 功能描述:EXTENSION LEAD 8GANG INTELLIPANEL 制造商:GJD 功能描述:EXTENSION LEAD, 8GANG, INTELLIPANEL |
| INTELLIPLUG | 制造商:GLOBAL COMMUNICATIONS 功能描述:ADAPTOR 3WAY INTELLIPLUG |
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