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參數(shù)資料
| 型號(hào)： | INTEL82801 |
| 廠商： | Intel Corp. |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | 82801AB（ICH0）I / O控制器集線器 |
| 文件頁數(shù)： | 57/414頁 |
| 文件大?。?/td> | 2140K |
| 代理商： | INTEL82801 |
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82801AA and 82801AB Datasheet
5-7
Functional Description
5.2.1.6
SYNC Time-out
There are several error cases that can occur on the LPC Interface.
Table 5-6
indicates the failing
case and the ICH response.
NOTE:
There may be other peripheral failure conditions; however, these are not handled by the ICH.
5.2.1.7
SYNC Error Indication
The SYNC protocol allows the peripheral to report an error via the LAD[3:0] = ‘1010b’ encoding.
The intent of this encoding is to give peripherals a method of communicating errors to aid higher
layers with more robust error recovery.
If the ICH was reading data from a peripheral, data is still transferred in the next two nibbles. This
data may be invalid, but it must be transferred by the peripheral. If the ICH was writing data to the
peripheral, the data had already been transferred.
In the case of multiple byte cycles, such as for memory and DMA cycles, an error SYNC
terminates the cycle. Therefore, if the ICH is transferring 4 bytes from a device, if the device
returns the error SYNC in the first byte, the other three bytes are not transferred.
Upon recognizing the SYNC field indicating an error, the ICH treats this the same as IOCHK#
going active on the ISA bus.
5.2.1.8
LFRAME# Usage
Start of Cycle
For Memory, I/O, and DMA cycles, the ICH asserts LFRAME# for 1 clock at the beginning of the
cycle (
Figure 5-5
) During that clock, the ICH drives LAD[3:0] with the proper START field.
Table 5-6. ICH Response to Sync Failures
Possible Sync Failure
ICH Response
ICH starts a Memory, I/O, or DMA cycle, but no device drives a valid SYNC after
4 consecutive clocks. This could occur if the processor tries to access an I/O
location to which no device is mapped.
ICH aborts the cycle after
the 4
clock.
ICH drives a Memory, I/O, or DMA cycle, and a peripheral drives more than 8
consecutive valid SYNC to insert wait states using the Short (‘0101b’) encoding
for SYNC. This could occur if the peripheral is not operating properly.
Continues waiting
ICH starts a Memory, I/O, or DMA cycle, and a peripheral drives an invalid
SYNC pattern. This could occur if the peripheral is not operating properly or if
there is excessive noise on the LPC Interface.
ICH aborts the cycle when
the invalid Sync is
recognized.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| INTEL82802AB | Firmware Hub (FWH) |
| INTELDX2 | High-Performance 32-Bit Embedded Processor(高性能32位嵌入式處理器) |
| INTELDX4 | Embedded Write-Back Enhanced Processor(32位回復(fù)嵌入式增強(qiáng)型處理器) |
| IPS54511 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
| IPS5451 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| INTEL82802AB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Firmware Hub (FWH) |
| INTELLIGENT CHARGER + 4AA | 制造商:Energizer 功能描述:Bulk |
| INTELLI-INCH-LR-STARTER K | 制造商:ALL MOTION 功能描述:Intelli-Inch Stepper & Controller Starter Kit |
| INTELLIPANEL | 制造商:GJD 功能描述:EXTENSION LEAD 8GANG INTELLIPANEL 制造商:GJD 功能描述:EXTENSION LEAD, 8GANG, INTELLIPANEL |
| INTELLIPLUG | 制造商:GLOBAL COMMUNICATIONS 功能描述:ADAPTOR 3WAY INTELLIPLUG |
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