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參數(shù)資料
| 型號(hào)： | INTEL82801 |
| 廠商： | Intel Corp. |
| 英文描述： | 82801AB (ICH0) I/O Controller Hub |
| 中文描述： | 82801AB（ICH0）I / O控制器集線器 |
| 文件頁(yè)數(shù)： | 160/414頁(yè) |
| 文件大?。?/td> | 2140K |
| 代理商： | INTEL82801 |
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Functional Description
5-110
82801AA and 82801AB Datasheet
5.17.2
AC-link Output Frame (SDOUT)
A new audio output frame begins with a low to high transition of AC_SYNC. AC_SYNC is
synchronous to the rising edge of BIT_CLK. On the immediately following falling edge of
BIT_CLK, the codec samples the assertion of AC_SYNC. This falling edge marks the time when
both sides of AC-link are aware of the start of a new frame. On the next rising edge of BIT_CLK,
the ICH transitions SDOUT into the first bit position of slot 0, or the valid frame bit. Each new bit
position is presented to the AC-link on a rising edge of BIT_CLK and subsequently sampled by the
codec on the following falling edge of BIT_CLK. This sequence ensures that data transitions and
subsequent sample points for both incoming and outgoing data streams are time aligned.
The output frame data phase corresponds to the multiplexed bundles of all digital output data
targeting codec DAC inputs and control registers. Each output frame supports up to twelve
outgoing data time slots. The ICH generates 16-bit samples and, in compliance with the AC’97
specification, pads the 4 least significant bits of valid slots with zeros.
The output data stream is sent with the most significant bit first and all invalid slots are stuffed with
zeros. When mono audio sample streams are output from the ICH, software must ensure both left
and right sample stream time slots are filled with the same data.
Output Slot 0: Tag Phase
Slot 0 is considered the tag phase. The tag phase is a special 16 bit time slot where each bit conveys
a valid tag for its corresponding time slot within the current frame. A one in a given bit position of
slot 0 indicates that the corresponding time slot within the current frame has been assigned to a data
stream and contains valid data. If a slot is tagged invalid with a zero in the corresponding bit
position of slot 0, the ICH stuffs the corresponding slot with zeros during that slot’s active time.
Within slot 0, the first bit is a valid frame bit (slot 0, bit 15) that flags the validity of the entire
frame. If the valid frame bit is set to one, this indicates that the current frame contains at least one
slot with valid data. When there is no transaction in progress, the ICH deasserts the frame valid bit.
Note that after a write to slot 12, that slot will always stay valid, and therefore the frame valid bit
will remain set.
The next 12 bit positions of slot 0 (bits [14:3]) indicate which of the corresponding twelve time
slots contain valid data. Bits [1:0] of slot 0 are used as codec ID bits to distinguish between
separate codecs on the link.
Using the valid bits in the tag phase allows data streams of differing sample rates to be transmitted
across the link at its fixed 48 kHz frame rate. The codec can control the output sample rate of the
ICH using the SLOTREQ bits as described in the AC’97 specification.
Output Slot 1: Command Address Port
The command port is used to control features and monitor status of AC‘97 functions including, but
not limited to, mixer settings and power management. The control interface architecture supports
up to 64 16-bit read/write registers, addressable on even byte boundaries. Only the even registers
(00h, 02h, etc.) are valid. Output frame slot 1 communicates control register address, and write/
read command information.
In the case of the split codec implementation, accesses to the codecs are differentiated by the driver
using address offsets 00h - 7Fh for the primary codec and address offsets 80h–FEh for the
secondary codec. The differentiation on the link, however, is done via the codec ID bits. See
Section 5.17.4
for further details.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| INTEL82802AB | Firmware Hub (FWH) |
| INTELDX2 | High-Performance 32-Bit Embedded Processor(高性能32位嵌入式處理器) |
| INTELDX4 | Embedded Write-Back Enhanced Processor(32位回復(fù)嵌入式增強(qiáng)型處理器) |
| IPS54511 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
| IPS5451 | FULLY PROTECTED HIGH SIDE POWER MOSFET SWITCH |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| INTEL82802AB | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Firmware Hub (FWH) |
| INTELLIGENT CHARGER + 4AA | 制造商:Energizer 功能描述:Bulk |
| INTELLI-INCH-LR-STARTER K | 制造商:ALL MOTION 功能描述:Intelli-Inch Stepper & Controller Starter Kit |
| INTELLIPANEL | 制造商:GJD 功能描述:EXTENSION LEAD 8GANG INTELLIPANEL 制造商:GJD 功能描述:EXTENSION LEAD, 8GANG, INTELLIPANEL |
| INTELLIPLUG | 制造商:GLOBAL COMMUNICATIONS 功能描述:ADAPTOR 3WAY INTELLIPLUG |
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