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參數(shù)資料
| 型號(hào)： | S1C88409D |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8.8 MHz, MICROCONTROLLER, UUC108 |
| 封裝： | DIE-108 |
| 文件頁數(shù)： | 100/250頁 |
| 文件大小： | 1877K |
| 代理商： | S1C88409D |
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S1C88409 TECHNICAL MANUAL
EPSON
179
CHAPTER 5: PERIPHERAL CIRCUITS AND OPERATION (A/D Converter)
Setting of input clock (PSAD)
Turning clock output ON (PRAD)
Setting of analog input terminals
(PAD)
Writing to CHS register
=selection of analog input channel
Writing to ADRUN register
=starting A/D conversion
Fig. 5.18.4.1 Flowchart for starting A/D conversion
An A/D conversion is completed when the
conversion result is loaded into the ADDR register.
At that point, the A/D converter generates an
interrupt (explained in the next section).
Figure 5.18.4.2 shows the timing chart of A/D
conversion.
5.18.5 Interrupt function
The A/D converter can generate an interrupt
when an A/D conversion has completed.
Figure 5.18.5.1 shows the configuration of the A/D
converter interrupt circuit.
The A/D converter sets the interrupt factor flag
FAD to "1" when it stores the conversion.
At this time, if the interrupt enable register EAD is
"1" and the interrupt priority register PAD (2 bits)
is set to a higher level than the setting of the
interrupt flags (I0 and I1), an interrupt is generated
to the CPU.
By setting the EAD register to "0", the interrupt to
the CPU can also be disabled. However, the
interrupt factor flag is set to "1" when an A/D
conversion has completed regardless of the
interrupt enable register and interrupt priority
register settings.
The interrupt factor flag set in "1" is reset to "0" by
writing "1".
Refer to Section 5.20, "Interrupt and Standby
Mode", for details of the interrupt control registers
and operations subsequent to interrupt generation.
The exception processing vector address for the A/
D conversion completion interrupt has been set in
000026H.
Writing to ADRUN register
Input sampling
Successive conversion
ADDR register
Interrupt request
tAD
Sampling time
8tCLK
tAD:
tCLK:
0 to 1tCLK
Input clock cycle
Conversion result
A/D conversion time
21tCLK+tAD
Fig. 5.18.4.2 Timing chart of A/D conversion
Data
bus
Interrupt
request
Address
A/D conversion
completion
Interrupt factor flag
FAD
Address
Interrupt enable
register EAD
Interrupt priority
level judgment
circuit
Address
Interrupt priority register
PAD0, PAD1
Fig. 5.18.5.1 Configuration of A/D converter interrupt circuit
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PDF描述 |
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參數(shù)描述 |
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| S1C88655 | 制造商:EPSON 制造商全稱:EPSON 功能描述:8-bit Single Chip Microcomputer |
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