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參數(shù)資料
| 型號(hào)： | AMD-8151 |
| 英文描述： | AMD-8151 - Preliminary AMD-8151 HyperTransport AGP3.0 Graphics Tunnel Data Sheet |
| 中文描述： | AMD的8151 -初步的AMD - 8151 HyperTransport的AGP3.0圖形隧道數(shù)據(jù)表 |
| 文件頁數(shù)： | 9/378頁 |
| 文件大?。?/td> | 3300K |
| 代理商： | AMD-8151 |
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List of Figures
9
24674
Rev. 3.00
April 2003
AMD-8111 HyperTransport I/O Hub Data Sheet
AMD Preliminary Information
List of Figures
Figure 1.
Figure 2.
Figure 3.
Figure 4.
Figure 5.
Figure 6.
Figure 7.
Figure 8.
Figure 9.
Figure 10.
Figure 11.
Figure 12.
Figure 13.
Figure 14.
Figure 15.
Figure 16.
Figure 17.
Figure 18.
Figure 19.
Figure 20.
Figure 21.
Figure 22.
Figure 23.
Figure 24.
Figure 25.
Figure 26.
Figure 27.
Figure 28.
Figure 29.
Figure 30.
Figure 31.
Figure 32.
Figure 33.
Figure 34.
Figure 35.
Figure 36.
System Block Diagram.....................................................................................................2
Interrupt Sources.............................................................................................................41
Vectored Interrupt Routing.............................................................................................42
High Precision Event Timer Block Diagram..................................................................47
High Precision Event Timer Interrupt Routing...............................................................49
SMBus Controller Interrupt Model.................................................................................52
STS to Interrupt Routing.................................................................................................55
Device Monitors and Retrigger Timers..........................................................................56
System Power State Transitions .....................................................................................59
Transitions from MOFF to SOFF and from SOFF/STD/STR to FON...........................61
Transitions from FON to SOFF/STD/STR.....................................................................62
GPIO Pin Format............................................................................................................67
AC ‘97 Codec Connections ............................................................................................68
Output Frame with Audio Samples in Half Rate Transfer Mode...................................74
Input Frame with Audio Samples in Half Rate Transfer Mode......................................74
USB Controller Building Blocks....................................................................................76
Receive and Transmit Descriptor Rings.........................................................................81
ISO 8802-3 (IEEE/ANSI 802.3) Data Frame.................................................................90
Conduit Mode Transmission with One Collision...........................................................93
Conduit Mode Excessive Collisions Error......................................................................93
Address Match Logic......................................................................................................96
IEEE 802.3 Frame and Length Field Transmission Order .............................................97
VLAN-Tagged Frame Format......................................................................................105
Internal and External Loopback Paths..........................................................................107
Media Independent Interface........................................................................................109
Frame Format at the MII Interface Connection............................................................111
Auto-Poll and Auto-Poll Data Registers.......................................................................113
Indirect Access to Auto-Poll Data Registers ................................................................114
Pattern Match RAM......................................................................................................129
Configuration Space (Primary and Secondary Bus).....................................................136
FERR_L and IGNNE_L Logic.....................................................................................166
Receive Descriptor Format...........................................................................................347
Format of FLAGS in Receive Descriptor, Offset 08h..................................................347
Transmit Descriptor Format..........................................................................................349
Format of TFLAGS1 in Transmit Descriptor, Offset 00h............................................350
BGA Designations (Top Side View)............................................................................361
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AMD64 | AMD64 Architecture Programmer＇s Manual Volume 1: Application Programming |
| AMDATHLON | AMD Athlon - AMD Athlon Processor Model 4 Revision Guide |
| AMDATHLON64 | AMD Athlon 64 - Report of Management on Processor Performance Benchmarks AMD Athlon 64 Processor 3200+ |
| AMDATHLONMP | AMD Athlon MP - AMD Athlon MP Processor Model 6 Data Sheet |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| AMD8255A-5 | 制造商:Advanced Micro Devices 功能描述:8255A-5 |
| AMD8257 | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:Programmable DMA Controller |
| AMD850-N14BD | 制造商:SMC Corporation of America 功能描述:MICRO MIST SEPARATOR W/ 1-1/4INCH PORTS |
| AMD8ATCBK | 制造商:Wiremold / Legrand 功能描述:FLUSH POKE-THRU ASSY/BK/TC |
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