參數(shù)資料
型號(hào)： AMD-8151
英文描述： AMD-8151 - Preliminary AMD-8151 HyperTransport AGP3.0 Graphics Tunnel Data Sheet
中文描述： AMD的8151 -初步的AMD - 8151 HyperTransport的AGP3.0圖形隧道數(shù)據(jù)表
文件頁(yè)數(shù)： 228/378頁(yè)
文件大小： 3300K
代理商： AMD-8151
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228
Registers
Chapter 4
AMD-8111 HyperTransport I/O Hub Data Sheet
24674
Rev. 3.00
April 2003
AMD Preliminary Information
Global SMI Enable Register
PM2A
Most of these bits enable the status bits to generate SMI interrupts. For each of these bits: 1=enable
the corresponding STS bit in the specified register to generate an SMI interrupt, regardless as to the
state of PM04[SCI_EN].
Default:
0000h.
Attribute:
Read-write.
Global SMI Control Register
PM2C
Default:
0000h.
Attribute:
See below.
Bits
15
14
13
12
11
10
9
8
7
6
5
4
Description
USBSMI_EN. USB resume SMI enable.
Generate SMI when PM20[USBRSM_STS]=1.
RISMI_EN. RI_L pin SMI enable.
Generate SMI when PM20[RI_STS]=1.
SBSMI_EN. SLPBTN_L pin SMI enable.
Generate SMI when PM00[SLPBTN_STS]=1.
PBSMI_EN. PWRBTN_L pin SMI enable.
Generate SMI when PM00[PWRBTN_STS]=1.
SMBSMI_EN. SMBus event SMI enable.
Generate SMI when PM28[SMBUS_EVT]=1.
THMSMI_EN. THERM_L pin SMI enable.
Generate SMI when PM20[THERM_STS]=1.
EXTSMI_EN. External SMI pin SMI enable.
Generate SMI when PM20[EXTSMI_STS]=1.
PMESMI_EN. PME_L pin SMI enable.
Generate SMI when PM20[PME_STS]=1.
SWISMI_EN. Software SMI enable.
Generate SMI when PM28[SWI_STS]=1.
BIOSSMI_EN. BIOS SMI enable.
Generate SMI when PM28[BIOS_STS]=1.
SITSMI_EN. System inactivity timer time out SMI enable.
Generate SMI when PM20[SIT_STS]=1.
IRQ_RSM. Resume from POS on unmasked interrupt.
1=Enable resume from POS when
PM28[IRQRSM_STS] is set High.
BMSMI_EN. Bus master SMI enable.
Generate SMI when PM00[BM_STS]=1.
LIDSMI_EN. LID pin SMI enable.
Generate SMI when PM20[LID_STS]=1.
TCO_EN. TCO SMI interrupt enable.
Generate SMI when PM28[TCO_EVT]=1. Note: if
PM48[NMI2SMI_EN]=1, PM44[NMI2SMI_STS] generates SMI interrupts regardless of the state of
this bit. Even if the TCO_EN bit is 0, NMIs are routed to generate SMIs.
ACAVSMI_EN. ACAV pin SMI enable.
Generate SMI when PM20[ACAV_STS]=1.
3
2
1
0
Bits
15:8
7
Description
Reserved.
SMBCSMI_EN. SMBus controller system management event SMI enable.
Read-write. 1=An SMI
is generated if PM20[SMBC_STS] goes High.
Reserved.
Software should only write a
‘
0
’
to this bit.
SMIACT. SMI active.
Read; set by hardware; write 1 to clear. This bit is set High by the hardware on
the leading edge of the SMI output. If SMILK is High, then SMIACT holds the SMI_L pin in the active
state. If SMILK is Low, then SMIACT has no effect on the SMI signal.
SMILK. SMI lock control.
Read-write. 1=The SMI_L pin is locked into the active state by a latch after
it is asserted. The latch is controlled by SMIACT. 0=The state of SMIACT does not affect SMI_L.
6
5
4
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