參數(shù)資料
型號(hào)： AMD-8151
英文描述： AMD-8151 - Preliminary AMD-8151 HyperTransport AGP3.0 Graphics Tunnel Data Sheet
中文描述： AMD的8151 -初步的AMD - 8151 HyperTransport的AGP3.0圖形隧道數(shù)據(jù)表
文件頁(yè)數(shù)： 319/378頁(yè)
文件大小： 3300K
代理商： AMD-8151
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Chapter 4
Registers
319
24674
Rev. 3.00
April 2003
AMD-8111 HyperTransport I/O Hub Data Sheet
AMD Preliminary Information
LAN Ethernet Controller Auto-Poll 5
ENC92
Default:
Bits
15
0000h
Description
AP_REG5_EN. Enable Bit for Autopoll Register 5
. When this bit and the Auto-Poll External PHY bit
(APEP) in CMD3 are both set to 1, the Auto-Poll State Machine periodically reads the external PHY
register selected by the AP_PHY5_ADDR and AP_REG5_ADDR
fi
elds and sets the APINT5 interrupt
bit if it detects a change in the register
’
s contents.
14:13 Reserved
12:8
AP_REG5_ADDR. AP_REG5 Address
. This
fi
eld contains the register number of an external PHY
register that the Auto-Poll State Machine periodically reads if the AP_REG5_EN bit in this register and
the APEP bit (CMD3, bit 10) are set.
7
Reserved.
6
AP_PRE_SUP5. Auto-Poll Preamble Suppression
. If this bit is set to 1, the Auto-Poll State Machine
suppresses the preambles of the MII Management Frames that it uses to periodically read the external
PHY register selected by the AP_PHY5_ADDR and AP_REG5_ADDR
fi
elds.This bit is ignored when
the AP_PHY5_DFLT bit is set.
5
AP_PHY5_DFLT. Auto-Poll PHY5 Default
. When this bit is set, the Auto-Poll State Machine ignores
the contents of the AP_PHY5_ADDR and AP_PRE_SUP5
fi
elds and uses the AP_PHY0_ADDR
fi
eld
for the address of the PHY device to be polled. If this bit is set, the Auto-Poll State Machine
suppresses preambles only if the Port Manager has determined that the default external PHY can
accept MII Management Frames without preambles. (The Port Manager examines bit 6 in register 1 of
the default PHY to make this determination.)
4:0
AP_PHY5_ADDR. Auto-Poll PHY5 Address
. This
fi
eld contains the address of the external PHY that
contains AP_REG5.This bit is ignored when the AP_PHY5_DFLT bit is set.
Attribute:
Read-write; write mode 1.
This register controls the automatic polling of a user-selectable external PHY register, AP_REG5.
This register is reset by H_RESET.
LAN Ethernet Controller Receive Ring Base Address
ENC120
Default:
Bits
31:0
0000_0000h
Description
BADR. Base address of receive descriptor ring
.
Attribute:
Read-write.
This 32-bit register allows the Receive Descriptor Ring to be located anywhere in a 32-bit address
space. This register is reset by RESET_L.
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