參數(shù)資料
型號(hào)： AMD-8151
英文描述： AMD-8151 - Preliminary AMD-8151 HyperTransport AGP3.0 Graphics Tunnel Data Sheet
中文描述： AMD的8151 -初步的AMD - 8151 HyperTransport的AGP3.0圖形隧道數(shù)據(jù)表
文件頁(yè)數(shù)： 234/378頁(yè)
文件大小： 3300K
代理商： AMD-8151
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234
Registers
Chapter 4
AMD-8111 HyperTransport I/O Hub Data Sheet
24674
Rev. 3.00
April 2003
AMD Preliminary Information
The following provides the field definitions for bits[19:0] common to each of the sixteen 32-bit
registers from PM50 to PM8C. See PM50-PM8C bits[31:20], below, for the unique bit definitions.
Default:
Offset:
0000h (for each register).
8Fh-40h (four bytes for each register).
Attribute:
See below.
Floppy Disk Controller Device Monitor Unique Controls
PM50 Bits[31:20]
See PM[8C:50], above, for bits[19:0].
Default:
0000 0000h.
Attribute:
Read-write.
Bits
31:20 See PM50-PM8C below
19
Reserved.
18
TMR_EN. Re-trigger timer enable.
Read-write. 1=Enable the re-trigger timer to decrement and to
set the corresponding bit in the device monitor status register (PMA0) to generate an SMI or SCI
interrupt. 0=Disable. If the timer is enabled and decrements past zero, then the PMA0 status bit is set
and the timer stops (at zero). Also, whenever a High is written to TMR_EN, the corresponding re-
trigger timer is loaded with its reload value.
17
SIT_RLD. System inactivity timer reload on device monitor event.
Read-write. 1=Enable system
inactivity timer (PM98) to be reloaded by associated device monitor events; the event (not the
associated STS bit) causes the SIT to be reloaded. 0=SIT not reloaded by associated device monitor
event.
16
Reserved.
15:14
CLKSRC. Clock source.
Read-write. Speci
fi
es the clock to the re-trigger timer per the following
table.
CLKSRC
Clock period
00b
1 millisecond
01b
32 milliseconds
10b
1 second
11b
64 seconds
13:7
CURCOUNT. Re-trigger timer current count value
. Read-only.
6:0
RELOAD. Re-trigger timer reload value.
Read-write. Device monitor events cause the re-trigger
timer to be loaded with the state of this register. Also, writes to this
fi
eld cause the re-trigger counter
CURCOUNT to be updated.
Description
Maximum time (clock times 128)
128 milliseconds
4.1 seconds
128 seconds = 2.13 minutes
136.5 minutes = 2.28 hours
Bits
31:23 Reserved.
22
FDCDEC_EN. Floppy disk controller decode enable.
1=Enable accesses to
fl
oppy disk controller
address range speci
fi
ed by PM50[FDCDEC_SEL] to generate a device monitor event. 0=Disable.
21
FDCDEC_SEL. Floppy disk controller decode select.
This selects the
fl
oppy disk controller I/O
address range for the FDC device monitor events. 1=Secondary FDC Address (370h-375h, 377h).
0=Primary FDC Address (3F0h-3F5h, 3F7h).
20
FDCDMA_EN. Floppy disk controller DMA enable.
1=Enable DMA channel 2 to generate the FDC
device monitor event. 0=Disable.
Description
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