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參數(shù)資料
| 型號(hào)： | MB90F562 |
| 廠商： | Fujitsu Limited |
| 英文描述： | Octal Bus Transceivers And Registers With 3-State Outputs 24-CDIP -55 to 125 |
| 中文描述： | 16位微控制器 |
| 文件頁(yè)數(shù)： | 161/581頁(yè) |
| 文件大?。?/td> | 3144K |
| 代理商： | MB90F562 |
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MB90560 series
CHAPTER 6 INTERRUPTS
137
I
Hardware interrupt operation
Figure 6.4-2 shows hardware interrupt operation from generation of a hardware interrupt to the
completion of interrupt processing.
Figure 6.4-2 Hardware interrupt operation
(1) An interrupt cause is generated by the peripheral function.
(2) The interrupt enable bit of the peripheral function is checked. If the interrupt is enabled, the
interrupt request is sent from the peripheral function to the interrupt controller.
(3) The interrupt controller determines the priority of simultaneous interrupt requests, then
transfers the interrupt level (IL) that matches the corresponding interrupt request to the CPU.
(4) The CPU compares the interrupt level (IL) requested by the interrupt controller with the
interrupt level mask register (ILM).
(5) If the comparison indicates a higher priority than the current interrupt processing level, the
CPU checks the contents of the I flag in the condition code register (CCR).
(6) If in the check in (5) shows that the I flag is interrupt enabled (I = 1), the CPU waits until the
execution of the instruction currently being executed terminates. At termination, the CPU
sets the requested level (IL) in the ILM.
(7) Registers are saved, and processing branches to the interrupt processing routine.
(8) The interrupt cause that was generated in (1) is cleared by software in the interrupt
processing routine. Execution of the RETI instruction terminates the interrupt processing.
Internal bus
Microcode
Check
Comparator
Other peripheral
Peripheral function that generated
the interrupt request
Enable FF
Factor FF
Level
comparator
Interrupt
level IL
Interrupt controller
IL:
PS:
I:
ILM:
IR:
FF:
Interrupt level setting bit in the interrupt control register (ICR)
Processor status
Interrupt enable flag
Interrupt level mask register
Instruction register
Flip-flop
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