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參數(shù)資料
| 型號(hào)： | MB90F562 |
| 廠商： | Fujitsu Limited |
| 英文描述： | Octal Bus Transceivers And Registers With 3-State Outputs 24-CDIP -55 to 125 |
| 中文描述： | 16位微控制器 |
| 文件頁(yè)數(shù)： | 114/581頁(yè) |
| 文件大?。?/td> | 3144K |
| 代理商： | MB90F562 |
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90
CHAPTER 4 CLOCKS
MB90620 series
4.5
Oscillation Stabilization Wait Interval
When the system changes operation from a state in which the main clock is stopped
(such as at power-on, in stop mode and at watch-dog reset), a delay (an oscillation
stabilization wait interval) is required to stabilize the clock oscillation before operation
starts. When the switch from the main clock to a PLL clock occurs, an oscillation
stabilization wait interval is also required when PLL oscillation starts.
I
Oscillation stabilization wait interval
Ceramic and crystal oscillators generally take several milliseconds to 20 milliseconds to stabilize
at their natural frequency when oscillation starts.
For this reason, CPU operation is not allowed as soon as oscillation starts and is allowed only
after full stabilization of oscillation. After the oscillation stabilization wait interval has elapsed, the
clock is supplied to the CPU.
Because the oscillation stabilization time depends on the type of the oscillator (crystal, ceramic,
etc.), the proper oscillation stabilization wait interval for the oscillator used must be selected. An
oscillation stabilization wait interval is selected by setting the clock selection register (CKSCR).
In a switch from the main clock to a PLL clock, the CPU continues to operate on the main clock
during the oscillation stabilization wait interval for PLL. After this interval, the operating clock
switches to the PLL clock.
Figure 4.5-1 shows the operation after oscillation starts.
Figure 4.5-1 Operation when oscillation starts
Oscillator-activated Oscillation stabilization Normal operation start
oscillation time
wait interval
Start of oscillation
Stable oscillation
or change to PLL clock
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