參數(shù)資料
型號： TMXF28155
英文描述： TMXF28155 Super Mapper 155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
中文描述： TMXF28155超級映射五十一分之一百五十五Mbits /秒的SONET / SDH x28/x21的DS1/E1
文件頁數(shù)： 95/606頁
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代理商： TMXF28155
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Preliminary Data Sheet
May 2001
TMXF28155/51 Super Mapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
95
Agere Systems Inc.
8 TMUX Registers
(continued)
Table 95. TMUX_RLS_MODE_CTL, Receive Low-speed Control Parameters (R/W)
Address
Bit
Name
Function
Reset
Default
00
0
0x4001B
15:14
13
—
Reserved.
Receive Force Path AIS Insertion.
Control bit, when
set to a logic 1, causes the receive low-speed signal to
carry PAIS as well as asserting all AUTO_AIS[1
—
3]
(pins AC6, AE6, and AD6) (
Table 3
) outputs.
Receive Control Bit for Pointer Justifications.
Con-
trol bit, when set to a logic 1, causes the pointer inter-
preter to accept an increment or decrement only if 8 out
of 10 bits are correct; otherwise, it will accept an incre-
ment or decrement based on majority vote only.
Receive Signal Degrade Algorithm Input Selection.
Control bit, when set to a logic 1, causes the B2 errors
to contribute to the signal degrade calculation; other-
wise, the B1 error count is used.
Receive Signal Fail Algorithm Input Selection.
Con-
trol bit, when set to a logic, causes the B2 errors to con-
tribute to the signal degrade calculation; otherwise, the
B1 error count is used.
TMUX_J1MONMODE[2:0]
Receive J1 Monitor Mode.
There are six modes, as
defined in J1 monitor on
page 377
.
TMUX_J0MONMODE[2:0]
Receive J0 Monitor Mode.
There are six modes, as
defined in
Section 17.5.5 J0 Monitor on page 370
.
TMUX_S1MODE4
Receive S1 Monitor Mode.
Control bit, when set to a
logic 1, causes the most significant nibble of the S1 byte
to be monitored; otherwise, the entire S1 byte is moni-
tored.
TMUX_RLSPAROEG
Receive Low-speed Parity Odd or Even Generation.
Control bit, when set to a logic 1, forces the output parity
bit to be even; otherwise, the parity is odd.
TMUX_RCONCATMODE
Receive Concatenation Mode.
Control bit, when set to
a logic 1, causes the input pointer interpreter to operate
in concatenation mode. This mode is most likely used in
AU-4 mode; otherwise, three independent pointers are
expected.
TMUX_REPRDI_MODE
Receive Enhanced Path RDI Mode.
Control bit, when
set to a logic 1, causes the receive path RDI monitor to
monitor the enhanced (3-bit found in G1[3:1]) value of
path RDI; otherwise, a 1-bit value (G1[3]) is monitored.
TMUX_RPAIS_INS
12
TMUX_8ORMAJORITY
0
11
TMUX_SDB1B2SEL
0
10
TMUX_SFB1B2SEL
0
9:7
000
6:4
000
3
0
2
0
1
0
0
0
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PDF描述
TMXF84622 TMXF84622 155 Mbits/s/622 Mbits/s Interface SONET/SDH x84/x63 Ultramapper
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