參數(shù)資料
型號： TMXF28155
英文描述： TMXF28155 Super Mapper 155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
中文描述： TMXF28155超級映射五十一分之一百五十五Mbits /秒的SONET / SDH x28/x21的DS1/E1
文件頁數(shù)： 143/606頁
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代理商： TMXF28155
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Preliminary Data Sheet
May 2001
TMXF28155/51 Super Mapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
143
Agere Systems Inc.
9 SPE Mapper Registers
(continued)
Table 154. SPE_TAOH_CTL1
—
SPE_TAOH_CTL3, Tx Control for Alarm/OH Functions (R/W)
Address
Bit
Name
Function
Reset
Default
0x00
00
0x3001B 15:10
—
Reserved.
Transmit Data Odd/Even Parity Generate.
When 0, odd
parity is generated for transmit data; when 1, even parity is
generated.
REI and RDI Input Select.
Control bit, when 1, inserts
REI/RDI value from the protected channel REI/RDI lines;
otherwise, the value is inserted from the direct feedback
(receive to transmit) lines.
Force Path AIS in the Output.
Active-high.
Transmit N1 Insert Control.
Control bit, when 1, inserts
the value in SPE_TN1DINS[7:0] (
Table 157
) into the outgo-
ing N1 byte in the STS-1 frame; otherwise, the insert value
depends on SPE_TPOAC_N1 (
Table 154
) control bit.
Transmit K3 Insert Control.
Control bit, when 1, inserts
the value in SPE_TK3DINS[7:0] (
Table 157
) into the outgo-
ing K3 bytes; otherwise, the insert value depends on
SPE_TPOAC_K3 (
Table 154
) control bit.
Transmit H4 Insert Control.
Control bit, when 1, inserts
the overhead default value SMPR_OH_DEFLT (
Table 67
)
into the outgoing H4 bytes; otherwise, the insert value
depends on SPE_TPOAC_H4 (
Table 154
) control bit.
Transmit F3 Insert Control.
Control bit, when 1, inserts
the value in SPE_TF3DINS[7:0] (
Table 157
) into the outgo-
ing F3 byte in the STS-1 frame; otherwise, the insert value
depends on SPE_TPOAC_F3 (
Table 154
) control bit.
Transmit F2 Insert Control.
Control bit, when 1, inserts
the value in SPE_TF2DINS[7:0] (
Table 157
) into the outgo-
ing F2 byte in the STS-1 frame; otherwise, the insert value
depends on SPE_TPOAC_F2 (
Table 154
) control bit.
Transmit C2 Insert Control.
Control bit, when 1, inserts
the value in SPE_TC2DINS[7:0] (
Table 157
) into the outgo-
ing C2 byte in the STS-1 frame; otherwise, the insert value
depends on SPE_TPOAC_C2 (
Table 154
) control bit.
Transmit J1 Insert Control.
Control bit, when 1, inserts
the value in SPE_TJ1DINS[1
—
64][7:0] (
Table 163
) into the
outgoing J1 bytes; otherwise, the insert value depends on
SPE_TPOAC_J1 (
Table 154
) control bit.
Reserved.
SPE_TPOAC_OEPMON
Transmit POAC Odd or Even Parity Monitor.
When 1,
even parity is checked for transmit POAC channels; other-
wise, odd parity is checked.
SPE_TPOAC_N1
Transmit POAC N1 Byte Control.
Control bit, when 0, the
default value is inserted into the N1 byte in the transmit
frame. When 1, the TPOAC value is inserted in the N1 byte.
9
SPE_TD_OEPAR
8
SPE_ TREIRDISEL
0
7
6
SPE_TAISPINS
SPE_TN1INS
0
1
5
SPE_TK3INS
0
4
SPE_TH4INS
0
3
SPE_TF3INS
1
2
SPE_TF2INS
1
1
SPE_TC2INS
1
0
SPE_TJ1INS
0
0x3001C
15:8
7
—
0x00
0
6
0
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PDF描述
TMXF84622 TMXF84622 155 Mbits/s/622 Mbits/s Interface SONET/SDH x84/x63 Ultramapper
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