參數(shù)資料
型號： TMXF28155
英文描述： TMXF28155 Super Mapper 155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
中文描述： TMXF28155超級映射五十一分之一百五十五Mbits /秒的SONET / SDH x28/x21的DS1/E1
文件頁數(shù)： 509/606頁
文件大小： 9520K
代理商： TMXF28155
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Preliminary Data Sheet
May 2001
TMXF28155/51 Super Mapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
509
Agere Systems Inc.
21 28-Channel Framer Block Functional Description
(continued)
21.22.2 Receive Data Link Functional Description
This block extracts facility data links bits and stores them in a microprocessor access register bank:
I
D bits from the SLC-96 multisuperframe.
I
Sa bits from time slot 0 in CEPT basic and CRC-4 multiframes.
I
Data link bits from DDS frames.
The respective bits will always be extracted from the framed aligned receive line payload and stored in the facility
data link stack regardless of other configuration bits. The processor will have control of being alerted to stack
updates through the interrupt mask registers.
All frame types:
I
Support clear-on-read status and interrupt bits based on the setting of the input select signal.
21.22.3 SLC-96 Superframe Receive Data Link
I
Delineates the SLC-96 data link in the Fs signaling frame, extracts the 24 D bits, and stores in the internal mem-
ory stack.
I
Provides interrupt for stack ready.
I
Provides host access to stack using processor clock.
I
Supports loss of frame status.
Both basic frame alignment and multiframe alignment must be established before the data can be assumed valid.
The SLC-96 Fs bits are stored in the Rx stack as follows.
Table 589. Shared Rx Stack Format for SLC-96 Frames
* The value held in the bits left blank should be ignored by the host.
When the entire stack has been filled, the host is notified using the Rx stack ready interrupt. After the Rx stack
ready interrupt bit is set, the host has approximately 9 ms to read the stack.
21.22.4 DDS Receive Data Link Stack
I
Extracts data link bit (bit 6) from time slot 24 and stores into stack.
I
Provides interrupt for stack ready.
I
Provides host access to stack using processor clock to provide fast access.
I
Supports loss of frame status.
DDS frames are numbered 1 through 12 with the data link bits located in bit 6 of time slot 24 in every frame. Only
basic frame alignment must be established for the data link bits to be extracted.
The DDS stack is stored in the shared Rx stack as follows.
Word
0
1*
2*
3*
4*
15
0
C1
SB2
0
0
14
0
C2
SB3
0
0
13
0
C3
M1
0
0
12
1
C4
M2
0
0
11
1
C5
M3
0
0
10
1
C6
A1
0
0
9
0
8
0
7
0
6
1
5
1
4
1
3
0
0
0
0
0
2
0
0
0
0
0
1
0
0
0
0
0
0
0
0
0
0
0
C7
A2
0
0
C8
S1
0
0
C9
S2
0
0
C10
S3
0
0
C11 SB1
S4
0
0
SB4
0
0
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