參數資料
型號： TMXF28155
英文描述： TMXF28155 Super Mapper 155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
中文描述： TMXF28155超級映射五十一分之一百五十五Mbits /秒的SONET / SDH x28/x21的DS1/E1
文件頁數： 249/606頁
文件大小： 9520K
代理商： TMXF28155
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Preliminary Data Sheet
May 2001
TMXF28155/51 Super Mapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
249
Agere Systems Inc.
12 28-Channel Framer Registers
(continued)
Table 314. FRM_PMGR4, Performance Monitor Global Register 4 (R/W)
* P = 0x0 for the receive path, and P = 0x1 for the transmit path.
Table 315. FRM_PMGR5, Performance Monitor Global Register 5
—
PMGR5 (R/W)
* P = 0x0 for the receive path, and P = 0x1 for the transmit path.
Table 316. FRM_PMGR6, Performance Monitor Global Register 6 (R/W)
* P = 0x0 for the receive path, and P = 0x1 for the transmit path.
Table 317. FRM_PMGR7, Performance Monitor Global Register 7 (R/W)
These bits enable the errored events used to determine errored and severely errored seconds in the DS1 modes.
* P = 0x0 for the receive path, and P = 0x1 for the transmit path.
Address
*
Bit
Name
Function
Reset
Default
0x0140
0x80P33
15:0
FRM_SFSEST[15:0]
SF Severely Errored Second Threshold for All SF Format-
ted Channels.
Note:
A bursty errored second will be recorded if the number
of events is greater than the errored second threshold
but less than the severely errored second threshold.
There is a separate threshold for ESF and SF because
of the bit error provisioning in ESF (F
t
or F
s
).
Address
*
Bit
Name
Function
Reset
Default
0x0140
0x80P34
15:0
FRM_DCT[15:0]
DS1 Excessive CRC Threshold
—
Default 320.
This register
sets the one second CRC threshold at which an excessive CRC
error condition is reported and the one second CRC threshold at
which a reframe may be forced.
Address
*
Bit
Name
Function
Reset
Default
0x0140
0x80P35
15:0
FRM_ESFSEST[15:0]
ESF Severely Errored Second Threshold for All ESF
Formatted Channels.
A bursty errored second will be
recorded if the number of events is greater than the errored
second threshold but less than the severely errored second
threshold.
Address
*
Bit
Name
Function
Reset
Default
0x00
0
0
0
0
0
0
0
0
0
0x80P36
15:9
8
7
6
5
4
3
2
1
0
—
Reserved.
Must write to 0.
FRM_DSEF
DS1 Severely Errored Frame Enable.
See FRM_SEFS (
Table 400
).
FRM_DLFA
DS1 Loss of Frame Alignment Enable.
FRM_DRFA
DS1 Remote Frame Alarm Enable.
FRM_DSLIP
DS1 Slip Enable.
FRM_DLOS
DS1 Loss of Signal Enable.
FRM_DAIS
DS1 Alarm Indication Signal Enable.
FRM_DCRC
DS1 CRC-6 Error Enable.
FRM_DFS
DS1 Fs Framing Bit Error Enable (SF Only).
FRM_DFT
DS1 Ft Framing Bit Error Enable (SF and ESF).
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