- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄361795 > W83C554F W83C554F Highly Integrated System I/O Controller for Power PC TM (South Bridge) & UltraDMA/33 IDE Controller QFP 208 PDF資料下載
參數(shù)資料
| 型號： | W83C554F |
| 英文描述： | W83C554F Highly Integrated System I/O Controller for Power PC TM (South Bridge) & UltraDMA/33 IDE Controller QFP 208 |
| 中文描述： | W83C554F高度集成的系統(tǒng)的I / O控制器的Power PC商標(biāo)（南橋） |
| 文件頁數(shù)： | 39/159頁 |
| 文件大?。?/td> | 3991K |
| 代理商： | W83C554F |
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W83C553F
3.8
The Configuration Read command (C/BE[3:0]# = Ah during address phase) is used in slave mode to read the configuration
registers. 8-bit, 16-bit, 24-bit and 32-bit accesses are supported when the IDSEL is asserted and AD[1:0] are 00. The PCI
controller will respond to all Configuration Read cycles, even for bytes not used. A value of 00h will be read for each invalid
byte selected in the configuration address space. During the PCI address phase AD[7:2] define the DWORD accessed, while
the byte enables (C/BE[3:0]#) address the byte(s) within each DWORD.
Refer to Figure 3-4. The Slave Configuration Read command cycle is used by the host processor to read the PCI
configuration space in the W83C553F. This provides the processor with device information. It is a single, non-burst, 8, 16
or 32-bit transfer, of fixed duration, i.e. the W83C553F will assert TRDY# on the 4th bus cycle of the transfer.
Electrical Specifications
WINBOND SYSTEMS LABORATORY
36
PCI Configuration Read Cycle
Figure 3-4. Slave Configuration Read Timing
相關(guān)PDF資料 |
PDF描述 |
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