參數(shù)資料
型號: W83C554F
英文描述: W83C554F Highly Integrated System I/O Controller for Power PC TM (South Bridge) & UltraDMA/33 IDE Controller QFP 208
中文描述: W83C554F高度集成的系統(tǒng)的I / O控制器的Power PC商標(南橋)
文件頁數(shù): 140/159頁
文件大小: 3991K
代理商: W83C554F
W83C553F
6.1
This section provides timing information on PCI cycles supported by the W83C553F.
Timing Diagrams
WINBOND SYSTEMS LABORATORY
137
PCI Timing Diagrams
Table 6-1. PCI Clock Timing
Note
:
For 5V PCI Bus, measurements were taken from 0.4V to 2.4V.
All VDD are 4.75V to 5.25V
Parameter
Values
Min
30ns
Max
Notes
t1
CLK cycle time
The W83C553F will operate properly at any
frequency between 0 and 33 MHz.
t2
t3
t4
CLK high time
11ns
11ns
1V/ns
-
CLK low time
-
CLK slew rate
4V/ns
相關PDF資料
PDF描述
W83L519D Peripheral Miscellaneous
W86C451 UART
W86C452 UART
W86F3448D LC86F3548A
W86F3448M LC86F3548A
相關代理商/技術參數(shù)
參數(shù)描述
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