- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄361795 > W83C554F W83C554F Highly Integrated System I/O Controller for Power PC TM (South Bridge) & UltraDMA/33 IDE Controller QFP 208 PDF資料下載
參數(shù)資料
| 型號： | W83C554F |
| 英文描述： | W83C554F Highly Integrated System I/O Controller for Power PC TM (South Bridge) & UltraDMA/33 IDE Controller QFP 208 |
| 中文描述： | W83C554F高度集成的系統(tǒng)的I / O控制器的Power PC商標（南橋） |
| 文件頁數(shù)： | 22/159頁 |
| 文件大?。?/td> | 3991K |
| 代理商： | W83C554F |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁當前第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁
W83C553F
Pin Descriptions
WINBOND SYSTEMS LABORATORY
19
Table 2-4. IDE Interface Bus Signals
Pin Name
IDECS0#
Pin #
Input/
Output
Description
Drive Chip Select 0. This signal is decoded from the AD bus to
select both primary and secondary IDE Port Command Block
Registers.
Drive Chip Select 1. This signal is decoded from the AD bus to
select both primary and secondary IDE Port Auxiliary Registers.
Native or Legacy Mode Select. During reset, this pin is sampled as
an input to set the Native or Legacy mode of the bus master IDE
controller (Function 1). A high selects Native mode and a low
selects Legacy mode.
Drive I/O Write A. This signal is used jointly with IDECS0# and
IDECS1#. The rising edge of IDEIOWA# latches data into the
primary port IDE device.
Drive I/O Read A. This signal is used jointly with IDECS0# and
IDECS1#. The falling edge of IDEIORA# enables data from the
primary port IDE device. The data is latched internally on the rising
edge of IDEIORA#.
Drive I/O Write B. This signal is used jointly with IDECS0# and
IDECS1#. The rising edge of IDEIOWB# latches data into the
secondary port IDE device.
Drive I/O Read B. This signal is used jointly with IDECS0# and
IDECS1#. The falling edge of the IDEIORB# enables data from the
secondary port IDE device. The data is latched internally on the
rising edge of IDEIORB#.
87
Output
IDECS1#/
NAT/LEG#
86
Input/
Output
IDEIOWA#
85
Output
IDEIORA#
83
Output
IDEIOWB#
84
Output
IDEIORB#
82
Output
相關PDF資料 |
PDF描述 |
|---|---|
| W83L519D | Peripheral Miscellaneous |
| W86C451 | UART |
| W86C452 | UART |
| W86F3448D | LC86F3548A |
| W86F3448M | LC86F3548A |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| W83C554FY | 制造商:Nuvoton Technology Corp 功能描述:I/O Controller Phase Controller 制造商:Nuvoton Technology 功能描述:I/O Controller Phase Controller |
| W83E14 | 制造商:OMRON INDUSTRIAL AUTOMATION 功能描述:SYSMAC-C20 MANUAL DX CODE ZA |
| W83L177R | 制造商:WINBOND 制造商全稱:Winbond 功能描述:100MHZ 2-DIMM SDRAM BUFFER FOR NOTEBOOK |
| W83L197R-16 | 制造商:WINBOND 制造商全稱:Winbond 功能描述:2-CHIP 100MHZ CLOCK FOR BX NOTEBOOK |
| W83L351 | 制造商:WINBOND 制造商全稱:Winbond 功能描述:ExpressCard⑩ Power Interface Switch |
發(fā)布緊急采購，3分鐘左右您將得到回復。