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參數(shù)資料
| 型號： | PLI9080 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | PCI I/O ACCELERATOR |
| 中文描述： | 的PCI I / O加速器 |
| 文件頁數(shù)： | 75/133頁 |
| 文件大?。?/td> | 883K |
| 代理商： | PLI9080 |
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SECTION 4
PCI 9080
REGISTERS
PLX Technology, Inc., 1997
Page 67
Version 0.93
4.5.6 (MBOX5; PCI:54h, LOC:D4h) Mailbox Register 5
Table 4-53. (MBOX5; PCI:54h, LOC:D4h) Mailbox Register 5
Field
Description
Read
Write
Value after Reset
31:0
32 Bit Mailbox Register.
Yes
Yes
0
4.5.7 (MBOX6; PCI:58h, LOC:D8h) Mailbox Register 6
Table 4-54. (MBOX6; PCI:58h, LOC:D8h) Mailbox Register 6
Field
Description
Read
Write
Value after Reset
31:0
32 Bit Mailbox Register.
Yes
Yes
0
4.5.8 (MBOX7; PCI:5Ch, LOC:DCh) Mailbox Register 7
Table 4-55. (MBOX7; PCI:5Ch, LOC:DCh) Mailbox Register 7
Field
Description
Read
Write
Value after Reset
31:0
32 Bit Mailbox Register.
Yes
Yes
0
4.5.9 (P2LDBELL; PCI:60h, LOC:E0h) PCI to Local Doorbell Register
Table 4-56. (P2LDBELL; PCI:60h, LOC:E0h) PCI to Local Doorbell Register
Field
Description
Read
Write
Value after Reset
31:0
Doorbell Register. A PCI master can write to this register and generate a local interrupt
to the local processor. The local processor can then read this register to determine
which doorbell bit was asserted. The PCI master sets a doorbell by writing a 1 to a
particular bit. The local processor can clear a doorbell bit by writing a 1 to that bit
position.
Yes
Yes/Clr
0
4.5.10 (L2PDBELL; PCI:64h, LOC:E4h) Local to PCI Doorbell Register
Table 4-57. (L2PDBELL; PCI:64h, LOC:E4h) Local to PCI Doorbell Register
Field
Description
Read
Write
Value after Reset
31:0
Doorbell Register. The local processor can write to this register and generate a PCI
interrupt. A PCI master can then read this register to determine which doorbell bit was
asserted. The local processor sets a doorbell by writing a 1 to a particular bit. The PCI
master can clear a doorbell bit by writing a 1 to that bit position.
Yes
Yes/Clr
0
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PDF描述 |
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