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參數(shù)資料
| 型號(hào)： | PLI9080 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | PCI I/O ACCELERATOR |
| 中文描述： | 的PCI I / O加速器 |
| 文件頁數(shù)： | 70/133頁 |
| 文件大小： | 883K |
| 代理商： | PLI9080 |
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SECTION 4
PCI 9080
REGISTERS
PLX Technology, Inc., 1997
Page 62
Version 0.93
4.4.8 (DMRR; PCI:1Ch, LOC:9Ch) Local Range Register for Direct Master to PCI
Table 4-40. (LBRD0; PCI:18h, LOC:98h) Local Address Space 0/Expansion ROM Bus Region Descriptor Register
Field
Description
Read
Write
Value after Reset
15:0
Reserved (64 KB increments).
Yes
No
0
31:16
Specifies which local address bits to use for decoding a local to PCI bus access. Each
of the bits corresponds to a PCI address bit. Bit 31 corresponds to Address bit 31.
Write a value of 1 to all bits that must be included in decode and a 0 to all others. This
range register is used for Direct Master memory, I/O, or configuration accesses.
Yes
Yes
0
4.4.9 (DMLBAM; PCI:20h, LOC:A0h) Local Bus Base Address Register for Direct Master to
PCI Memory
Table 4-41. (DMLBAM; PCI:20h, LOC:A0h) Local Bus Base Address Register for Direct Master to PCI Memory
Field
Description
Read
Write
Value after Reset
15:0
Reserved.
Yes
No
0
31:16
Assigns a value to the bits to use for decoding a local to PCI memory access.
Yes
Yes
0
4.4.10 (DMLBAI; PCI:24h, LOC:A4h) Local Base Address Register for Direct Master to
PCI IO/CFG
Table 4-42. (DMLBAI; PCI:24h, LOC:A4h) Local Base Address Register for Direct Master to PCI IO/CFG
Field
Description
Read
Write
Value after Reset
15:0
Reserved.
Yes
No
0
31:16
Assigns a value to the bits to use for decoding a local to PCI I/O or configuration
access. This base address is used for both Direct Master I/O and configuration
accesses.
Yes
Yes
0
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