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參數(shù)資料
| 型號(hào)： | XPC801ZP25 |
| 元件分類： | 微處理器 |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 531/605頁 |
| 文件大?。?/td> | 2380K |
| 代理商： | XPC801ZP25 |
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Terminology
23-2
MPC801 USER’S MANUAL
MOTOROLA
23
burst length
length of four has four data pieces (four beats) associated with it.
—The number of data associated with a burst cycle. For example, a burst
bus park
cycle. This allows the same master to make the next transfer without having to
rearbitrate for the bus.
—Keeps the bus granted to a bus master although it has completed the bus
C
CAS
—Column address strobe.
copyback
or a transfer of bus control to an external master. At the time of forced update or
relinquishment of the bus, all changes to the cache are written to external memory. Until
that time, cache and external memory are not coherent.
—Updates to external memory are delayed until forced by the user program
critical-data first
organized where the word or data needed first is the first one to transfer within the
burst-data block. The order of transferring can be sequential and usually wraps back to
the word (or data) zero. For example, 1
2
data 1 as the critical data.
—This feature allows the data transferred during the burst cycle to be
3
0 for a sequence of four data with
D
datastream
—A sequence of information to be processed by the core.
DEC
—Decrementer.
E
EBI
—External bus interface.
execution serialization
currently in progress complete execution (all internal pipeline stages and instruction
buffers have emptied and all outstanding memory transactions are completed).
—Instruction issue is halted until all instructions that are
F
fetch serialization
processor have completed execution (all issued instructions as well as the prefetched
instructions waiting to be issued). The machine after fetch serialization is said to be
completely synchronized.
—Instruction fetch is halted until all instructions currently in the
fixed transaction
bus cycle into a single event.
—A bus transaction that combines the address and data phase of the
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XPC801ZP40 | Microprocessor |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| XPC823CVR66B2T | 功能描述:IC MPU POWERQUICC 66MHZ 256-PBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:MPC8xx 標(biāo)準(zhǔn)包裝:2 系列:MPC8xx 處理器類型:32-位 MPC8xx PowerQUICC 特點(diǎn):- 速度:133MHz 電壓:3.3V 安裝類型:表面貼裝 封裝/外殼:357-BBGA 供應(yīng)商設(shè)備封裝:357-PBGA（25x25） 包裝:托盤 |
| XPC823CZC66A | 制造商:Freescale Semiconductor 功能描述: |
| XPC823CZT66B2 | 制造商:Freescale Semiconductor 功能描述: |
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