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參數(shù)資料
| 型號： | XPC801ZP25 |
| 元件分類： | 微處理器 |
| 英文描述： | Microprocessor |
| 中文描述： | 微處理器 |
| 文件頁數(shù)： | 137/605頁 |
| 文件大?。?/td> | 2380K |
| 代理商： | XPC801ZP25 |
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PowerPC Architecture Compliance
7-14
MPC801 USER’S MANUAL
MOTOROLA
7
SRR1—Save/Restore Register 1
1
Set to 1 if the translation of an attempted access is not found in the translation
tables. Otherwise, set to 0.
2
Set to 0.
3
Set to 1 if the fetch access was to a guarded storage when MSR
IR
= 1 or when
bit 4 is set. Otherwise, set to 0.
4
Set to 1 if the storage access is not permitted by the protection mechanism;
otherwise set to 0. In the first revision when this bit is set, Bits 3 and 10 are
also set, but in future revisions this bit may be set alone.
10
Set to 1 when Bit 4 is set. Otherwise, set to 0.
11–15
Set to 0.
Other
Loaded from bits 16–31 of the MSR. In the current implementation, Bit 30 of
the SRR1 is never cleared, except by loading a zero value from MSR
RI
.
MSR—Machine State Register
IP
No change.
ME
No change.
LE
Bits are copied from the ILE.
Other
Set to 0.
Some instruction TLB registers are set to a value described in
Section 11 Memory
Management Unit
. Execution resumes at offset x’01300’ from the base address indicated
by MSR
IP
.
7.3.7.3.13 Implementation Specific Data TLB Miss Interrupt.
This type of interrupt
occurs when MSR
DR
=1 and there is an attempt to access a page whose effective page
number cannot be translated by TLB. The following registers are set:
SRR0—Save/Restore Register 0
Set to the effective address of the instruction that caused the interrupt.
SRR1—Save/Restore Register 1
1–4
Set to 0.
10–15
Set to 0.
Other
Loaded from bits 16–31 of the MSR. In the current implementation, Bit 30 of
the SRR1 is never cleared, except by loading a zero value from MSR
RI
.
MSR—Machine State Register
IP
No change.
ME
No change.
LE
Bits are copied from the ILE.
Other
Set to 0.
Some instruction TLB registers are set to the values described in
Section 11 Memory
Management Unit
. Execution resumes at offset x’01200’ from the base address indicated
by MSR
IP
.
相關PDF資料 |
PDF描述 |
|---|---|
| XPC801ZP40 | Microprocessor |
| XPC821ZP40 | Microprocessor |
| XPC823ZP25 | Microprocessor |
| XPC823ZP50 | Microprocessor |
| XPC8241LZP166 | Microprocessor |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XPC801ZP40 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
| XPC821ZP40 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Microprocessor |
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| XPC823CZC66A | 制造商:Freescale Semiconductor 功能描述: |
| XPC823CZT66B2 | 制造商:Freescale Semiconductor 功能描述: |
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