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參數(shù)資料
| 型號： | LR4500 |
| 廠商： | LSI Corporation |
| 英文描述： | Superscalar Microprocessor(超標(biāo)量微處理器) |
| 中文描述： | 超標(biāo)量微處理器（超標(biāo)量微處理器） |
| 文件頁數(shù)： | 144/172頁 |
| 文件大?。?/td> | 1142K |
| 代理商： | LR4500 |
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9-12
ICEport
9.5.2 Rx Setup Register
The write-only Rx Setup Register enables and disables the sc_ICEINTp
interrupt signal when the RxRDY bit in the Rx Status Register is set. If
software clears the RxRXRDYPe bit to zero, then the ICEport interrupt
signal sc_ICEINTp is disabled. This feature was added to allow software
to disable the interrupt signal, IRXRDYp (sc_ICEINTp).
In the LR4500 reference device, the ICEport’s interrupt IRXRDYp
(sc_ICEINTp) is tied to interrupt 4, which is a maskable interrupt.
Figure 9.4
shows the Rx Setup Register, with bit field descriptions
following the figure.
Figure 9.4 Rx Setup Register
R
Reserved Bits
These bits are reserved for LSI Logic and any writes to
these bits are ignored.
[31:1]
RxRXRDYPe
sc_ICEINTp (IRXRDYp) Enable
When this bit is set to one, the sc_ICEINTp signal reflects
the state of the RxRDY bit in the Rx Status Register.
When software clears RxRXRDYPe to zero, the
sc_ICEINTp signal is continually deasserted.
RXRXRDYPe clears to zero during an ICEport reset.
0
9.5.3 Rx Data Register
The read-only Rx Data Register, shown in
Figure 9.5
, holds received
data in bits [7:0]. RxData is valid only when the RxRDY bit in the Rx
Status Register is set. The Rx Data Register is undefined after an
ICEport reset.
31
1
0
R
RxRXRDYPe
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