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參數(shù)資料
| 型號： | LR4500 |
| 廠商： | LSI Corporation |
| 英文描述： | Superscalar Microprocessor(超標(biāo)量微處理器) |
| 中文描述： | 超標(biāo)量微處理器（超標(biāo)量微處理器） |
| 文件頁數(shù)： | 143/172頁 |
| 文件大?。?/td> | 1142K |
| 代理商： | LR4500 |
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ICEport Registers
9-11
9.5.1 Rx Status Register
The read-only Rx Status Register provides status information for ICEport
receive operations and indicates the state of the Rx Data Register.
Figure 9.3
shows the Rx Status Register.
Figure 9.3 Rx Status Register
RES
Reserved Bits
These bits are reserved for use by LSI Logic and are
read as zeros.
[31:2]
RxOverrun
Rx Overrun
This bit is set to one when an Rx overrun error occurs.
An Rx overrun error occurs when a new Rx byte is
received, as indicated by RxRDY, before the previous Rx
byte has been read. For an overrun error, the new byte
is not accepted and the pending byte in the Rx Data
Register is not lost.
1
When the RxOverrun bit is set, it signals that at least one
byte from the serial input stream of the new frame has
been lost. RxOverrun is cleared when the Rx Status
Register is read. This ensures that if another overrun
occurs between the Rx Status Register read and the Rx
Data Register read that this overrun will set RxOverrun.
RXOverrun clears to zero during an ICEport reset.
RxRDY
Rx Byte Ready
When the Rx block receives a byte, this bit is set to 1.
RxRDY clears to zero when the Rx Data Register is read,
and at reset. The IRXRDYp (sc_ICEINTp) output signal,
if enabled, reflects the state of the RxRDY bit.
0
31
2
1
0
RES
RxOverrun
RxRDY
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