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參數(shù)資料
| 型號： | DSP16410 |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | 16-bit fixed point DSP with Flash |
| 中文描述： | 具有閃存的 16 位定點(diǎn) DSP |
| 文件頁數(shù)： | 65/373頁 |
| 文件大?。?/td> | 5643K |
| 代理商： | DSP16410 |
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List of Tables
Table
Page
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
9
Data Sheet
June 2001
DSP16410B Digital Signal Processor
Table 1.
Table 2.
Table 3.
Table 4.
Table 5.
Table 6.
Table 7.
Table 8.
Table 9.
Table 10.
Table 11.
Table 12.
Table 13.
Table 14.
Table 15.
Table 16.
Table 17.
Table 18.
Table 19.
Table 20.
Table 21.
Table 22.
Table 23.
Table 24.
Table 25.
Table 26.
Table 27.
Table 28.
Table 29.
Table 30.
Table 31.
Table 32.
Table 33.
Table 34.
Table 35.
Table 36.
Table 37.
Table 38.
Table 39.
Table 40.
Table 41.
Table 42.
Table 43.
Table 44.
Table 45.
Table 46.
Table 47.
Table 48.
Table 49.
Table 50.
Table 51.
DSP16410B Block Diagram Legend ................................................................................................ 16
DSP16000 Core Block Diagram Legend.......................................................................................... 22
State of Device Output and Bidirectional Pins During and After Reset............................................ 24
Hardware Interrupts.......................................................................................................................... 27
imux
(Interrupt Multiplex Control) Register...................................................................................... 28
Global Disabling and Enabling of Hardware Interrupts..................................................................... 30
inc0
and
inc1
(Interrupt Control) Registers 0 and 1......................................................................... 31
ins
(Interrupt Status) Register.......................................................................................................... 32
Interrupt and Trap Vector Table ....................................................................................................... 33
psw1
(Processor Status Word 1) Register....................................................................................... 35
DSP16410B Memory Components .................................................................................................. 37
signal
Register................................................................................................................................. 46
Full-Duplex Data Transfer Code Through Core-to-Core Message Buffer ........................................ 47
DMAU MMT Channel Interrupts ....................................................................................................... 48
DMA Intracore and Intercore Transfers Example............................................................................. 48
sbit
(BIO Status/Control) Register ................................................................................................... 49
cbit
(BIO Control) Register............................................................................................................... 50
BIO Operations................................................................................................................................. 51
BIO Flags.......................................................................................................................................... 51
timer
0,1
c
(TIMER
0,1
Control) Register..................................................................................... 54
timer
0,1
(TIMER
0,1
Running Count) Register........................................................................... 55
ID
(JTAG Identification) Register...................................................................................................... 56
TCS 14-Pin Socket Pinout................................................................................................................ 57
JCS 20-Pin Socket Pinout................................................................................................................ 58
HDS 9-Pin, Subminiature, D-Type Plug Pinout ................................................................................ 59
JTAG0 Boundary-Scan Register...................................................................................................... 61
JTAG1 Boundary-Scan Register...................................................................................................... 62
DMAU Channel Assignment............................................................................................................. 63
DMAU Memory-Mapped Registers................................................................................................... 66
DSTAT
(DMAU Status) Register....................................................................................................... 68
DMCON0
(DMAU Master Control 0)
Register.................................................................................. 70
DMCON1
(DMAU Master Control 1)
Register.................................................................................. 71
Collective Designations Used in Table 34........................................................................................ 72
CTL
0—3
(SWT
0—3
Control) Registers...................................................................................... 73
Collective Designations Used in Table 36........................................................................................ 75
CTL
4—5
(MMT
4—5
Control) Registers ..................................................................................... 75
SADD
0—5
and
DADD
0—5
(Channels 0—5 Source and Destination Address) Registers ........ 76
SCNT
0—3
(SWT
0—3
Source Counter) Registers..................................................................... 77
SCNT
4—5
(MMT
4—5
Source Counter) Registers..................................................................... 77
DCNT
0—3
(SWT
0—3
Destination Counter) Registers .............................................................. 78
DCNT
4—5
(MMT
4—5
Destination Counter) Registers.............................................................. 78
LIM
0—3
(SWT
0—3
Limit) Registers .......................................................................................... 79
LIM
4—5
(MMT
4—5
Limit) Registers.......................................................................................... 79
SBAS
0—3
(SWT
0—3
Source Base Address) Registers ........................................................... 80
DBAS
0—3
(SWT
0—3
Destination Base Address) Registers..................................................... 80
STR
0—3
(SWT
0—3
Stride) Registers........................................................................................ 81
RI
0—3
(SWT
0—3
Reindex) Registers ....................................................................................... 81
SWT-Specific Memory-Mapped Registers ....................................................................................... 87
MMT-Specific Memory-Mapped Registers ....................................................................................... 90
DMAU Interrupts............................................................................................................................... 91
Overview of SEMI Pins................................................................................................................... 100
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