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參數(shù)資料
| 型號(hào)： | DSP16410 |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-bit fixed point DSP with Flash |
| 中文描述： | 具有閃存的 16 位定點(diǎn) DSP |
| 文件頁(yè)數(shù)： | 59/373頁(yè) |
| 文件大小： | 5643K |
| 代理商： | DSP16410 |
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Table of Contents
(continued)
Contents
Page
Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
3
4.6
4.7
4.8
Triport Random-Access Memory (TPRAM) .........................................................................................43
Shared Local Memory (SLM)...............................................................................................................44
Interprocessor Communication ............................................................................................................45
4.8.1
Core-to-Core Interrupts and Traps..........................................................................................46
4.8.2
Message Buffer Data Exchange .............................................................................................46
4.8.2.1
Message Buffer Write Protocol ...............................................................................47
4.8.2.2
Message Buffer Read Protocol...............................................................................47
4.8.3
DMAU Data Transfer...............................................................................................................48
Bit Input/Output Units (BIO
0—1
).......................................................................................................49
4.10 Timer Units (TIMER0_
0—1
and TIMER1_
0—1
) ...........................................................................52
4.11 Hardware Development System (HDS
0—1
).....................................................................................55
4.12 JTAG Test Port (JTAG
0—1
).............................................................................................................56
4.12.1 Port Identification ....................................................................................................................56
4.12.2 Emulation Interface Signals to the DSP16410B......................................................................57
4.12.2.1 TCS 14-Pin Header.................................................................................................57
4.12.2.2 JCS 20-Pin Header.................................................................................................58
4.12.2.3 HDS 9-Pin, D-Type Connector................................................................................59
4.12.3 Multiprocessor JTAG Connections..........................................................................................60
4.12.4 Boundary Scan........................................................................................................................61
4.13 Direct Memory Access Unit (DMAU)....................................................................................................63
4.13.1 Overview.................................................................................................................................63
4.13.2 Registers.................................................................................................................................66
4.13.3 Data Structures.......................................................................................................................82
4.13.3.1 One-Dimensional Data Structure (SWT Channels) ................................................82
4.13.3.2 Two-Dimensional Data Structure (SWT Channels) ................................................83
4.13.3.3 Memory-to-Memory Block Transfers (MMT Channels) ...........................................85
4.13.4 The PIU Addressing Bypass Channel.....................................................................................85
4.13.5 Single-Word Transfer Channels (SWT) ..................................................................................86
4.13.6 Memory-to-Memory Transfer Channels (MMT).......................................................................89
4.13.7 Interrupts and Priority Resolution............................................................................................91
4.13.8 Error Reporting and Recovery ................................................................................................93
4.13.9 Programming Examples..........................................................................................................94
4.13.9.1 SWT Example 1: A Two-Dimensional Array ...........................................................94
4.13.9.2 SWT Example 2: A One-Dimensional Array ...........................................................96
4.13.9.3 MMT Example.........................................................................................................98
4.14 System and External Memory Interface (SEMI)...................................................................................99
4.14.1 External Interface..................................................................................................................100
4.14.1.1 Configuration.........................................................................................................101
4.14.1.2 Asynchronous Memory Bus Arbitration.................................................................102
4.14.1.3 Enables and Strobes.............................................................................................103
4.14.1.4 Address and Data .................................................................................................105
4.14.2 16-Bit External Bus Accesses...............................................................................................107
4.14.3 32-Bit External Bus Accesses...............................................................................................107
4.14.4 Registers...............................................................................................................................108
4.14.4.1
ECON0
Register ...................................................................................................109
4.14.4.2
ECON1
Register ...................................................................................................110
4.14.4.3 Segment Registers ...............................................................................................111
4.14.5 Asynchronous Memory .........................................................................................................113
4.14.5.1 Functional Timing..................................................................................................113
4.14.5.2 Extending Access Time Via the ERDY Pin...........................................................117
4.14.5.3 Interfacing Examples ............................................................................................119
4.9
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