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參數(shù)資料
| 型號(hào)： | DSP16410 |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-bit fixed point DSP with Flash |
| 中文描述： | 具有閃存的 16 位定點(diǎn) DSP |
| 文件頁(yè)數(shù)： | 131/373頁(yè) |
| 文件大小： | 5643K |
| 代理商： | DSP16410 |
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
75
4 Hardware Architecture
(continued)
4.13 Direct Memory Access Unit (DMAU)
(continued)
4.13.2 Registers
(continued)
Table 35. Collective Designations Used in Table 36
Table 36. CTL
4—5
(MMT
4—5
Control) Registers
See
Table 29 starting on page 66
for the memory addresses of these registers.
15—6
Reserved
Collective
Designation
XSIZE
Description
Register or Register Field
See
Transfer Size for MMT4
XSIZE4 (
DMCON0
[12])
(0 for 16 bits or 1 for 32 bits)
XSIZE5 (
DMCON0
[13])
(0 for 16 bits or 1 for 32 bits)
SADD
4—5
DADD
4—5
SROW[12:0] (
SCNT
4—5
[19:7])
DROW[12:0] (
DCNT
4—5
[19:7])
LASTROW[12:0] (
LIM
4—5
[19:7])
Table 31 on page 70
Transfer Size for MMT5
ADD
Source Address
Destination Address
Source Row Counter
Destination Row Counter
Row Limit
Table 37 on page 76
ROW
Table 39 on page 77
Table 41 on page 78
Table 43 on page 79
LASTROW
5—4
3—1
0
POSTMOD[1:0]
SIGCON[2:0]
Reserved
Bit
Field
Value
Definition
R/W
Reset
Value
0
XX
15—6
5—4
Reserved
POSTMOD[1:0]
0
Reserved—write with zero.
The DMAU performs no pointer or counter update operations.
Reserved.
After every transaction:
R/W
R/W
00
01
10
If the row counter has not expired, the DMAU increments it and incre-
ments the address by the element size
. (If ROW
≠
LASTROW, then
ROW=ROW+1 and ADD=ADD+
1+
XSIZE.)
If the row counter has expired, the DMAU clears the row counter, incre-
ments the address by the element size
, and deactivates the channel.
(If ROW
=
LASTROW, then ROW=0 and ADD=ADD+
1+
XSIZE.)
Reserved.
The DMAU generates an interrupt request after each element
has been
transferred.
The channel generates an interrupt request following completion of a
transfer with ROW equal to LASTROW/2.
Reserved.
The channel generates an interrupt request following completion of a
transfer with ROW equal to LASTROW.
Reserved.
Reserved.
Reserved—write with zero.
11
000
3—1
SIGCON[2:0]
R/W
XXX
001
01X
100
101
11X
0
0
Reserved
R/W
0
For this column, X indicates unknown on powerup reset and unaffected on subsequent reset.
The element size is 1 for single-word transactions (XSIZE = 0) or 2 for double-word transactions (XSIZE = 1).
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