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參數(shù)資料
| 型號(hào)： | DSP16410 |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | 16-bit fixed point DSP with Flash |
| 中文描述： | 具有閃存的 16 位定點(diǎn) DSP |
| 文件頁(yè)數(shù)： | 341/373頁(yè) |
| 文件大小： | 5643K |
| 代理商： | DSP16410 |
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Data Sheet
June 2001
DSP16410B Digital Signal Processor
Agere Systems Inc.
Agere Systems—Proprietary
Use pursuant to Company instructions
285
11 Timing Characteristics and Requirements
(continued)
11.9 System and External Memory Interface
In the following timing diagrams and associated tables:
I
The designation ENABLErefers to one of the following pins: EROMN, ERAMN, or EION. The designation
ENABLES refers to all of the following pins: EROMN, ERAMN, and EION.
I
The designation ERWNrefers to:
—The ERWN0 pin if the external data bus is configured as 16 bits, i.e., if the ESIZE pin is logic low.
—The ERWN1 and ERWN0 pins if the external data bus is configured as 32 bits, i.e., if the ESIZE pin is logic
high.
—The ERWN1, ERWN0, and EA0 pins if the external data bus is configured as 32 bits, i.e., if the ESIZE pin is
logic high, and if the memory access is synchronous.
I
The designation EArefers to:
—The external address pins EA[18:0] and the external segment address pins ESEG[3:0] if the external data bus
is configured as 16 bits, i.e., if the ESIZE pin is logic low.
—The external address pins EA[18:1] and the external segment address pins ESEG[3:0] if the external data bus
is configured as 32 bits, i.e., if the ESIZE pin is logic high.
I
The designation EDrefers to:
—The external data pins ED[31:16] if the external data bus is configured as 16 bits, i.e., if the ESIZE pin is logic
low.
—The external data pins ED[31:0] if the external data bus is configured as 32 bits, i.e., if the ESIZE pin is logic
high.
I
The designation ATIME refers to IATIME (
ECON0
[11:8]) for accesses to the EIO space, YATIME (
ECON0
[7:4])
for accesses to the ERAM space, or XATIME (
ECON0
[3:0]) for accesses to the EROM space.
ECKO reflects CLK, i.e.,
ECON1
[1:0] = 1.
Figure 75. Enable and Write Strobe Transition Timing
Table 195. Timing Characteristics for ERWN and Memory Enables
Abbreviated Reference
t102
t103
t112
t113
Parameter
Min
0.5
0.5
0.5
0.5
Max
4
4
4
4
Unit
ns
ns
ns
ns
ECKO to ENABLEActive (high to low)
ECKO to ENABLEInactive (high to high)
ECKO to ERWNActive (high to low)
ECKO to ERWNInactive (high to high)
ENABLE
t102
ERWN
t113
t112
t103
ECKO
V
OH
–
V
OL
–
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DSP25-16AR | Phase-leg Rectifier Diode |
| DSP25 | Phase-leg Rectifier Diode |
| DSP25-12A | Phase-leg Rectifier Diode |
| DSP25-12AT | Phase-leg Rectifier Diode |
| DSP25-16A | Phase-leg Rectifier Diode |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DSP16410C | 制造商:AGERE 制造商全稱:AGERE 功能描述:DSP1629 Digital Signal Processor |
| DSP16410CG | 制造商:AGERE 制造商全稱:AGERE 功能描述:DSP16410CG Digital Signal Processor |
| DSP16411 | 制造商:AGERE 制造商全稱:AGERE 功能描述:DSP16411 Digital Signal Processor |
| DSP1643 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Telecommunication IC |
| DSP1648C | 制造商:AGERE 制造商全稱:AGERE 功能描述:Host-Based Controller V.92 Modem Chip Set |
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