參數(shù)資料
型號(hào)： Am79C965A
廠商： Advanced Micro Devices, Inc.
英文描述： PCnet?-32 Single-Chip 32-Bit Ethernet Controller
中文描述： PCnet？-32單芯片32位以太網(wǎng)控制器
文件頁(yè)數(shù)： 170/228頁(yè)
文件大小： 1681K
代理商： AM79C965A
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170
Am79C965A
6-2
RES
Reserved locations. Written as
ZEROs and read as undefined.
1-0
INTSEL
Interrupt Select. The value of these
bits determines which of the
interrupt pins will be the active
interrupt. Table 55 indicates which
interrupt will be selected for each
combination of INTSEL and
JTAGSEL values.
Interrupt pins that are not selected
will be floated.
The INTSEL register will contain the
value 00 following H_RESET and is
not affected by S_RESET or STOP.
Table 53. Software Style Selection
Table 54. Interrupt Select
Initialization Block
When SSIZE32=0 (BCR20/CSR58, bit 8) the software
structures are defined to be 16 bits wide and the
initialization block looks as shown in Table 55. When
SSIZE32=1, the software structures are defined to be
32 bits wide and the initialization block looks as shown
in Table 56. Regardless of the value of SSIZE32, the
initialization block must be aligned to a double word
boundary, i.e. CSR1[1:0] and CSR16[1:0] must be set
to ZERO.
Note that the PCnet-32 device performs double-word
accesses to read the initialization block. This statement
is always true, regardless of the setting of the SSIZE32
bit.
SWSTYLE[7:0]
(Hex)
Style Name
CSRPCNET
SSIZE32
Altered Bit Interpretations
00
LANCE/
PCnet-ISA
1
0
ALL CSR4 bits will function as defined in the CSR4 section.
TMD1[29] functions as ADD_FCS
01
ILACC
0
1
CSR4[9:8], CSR4[5:4] and CSR4[1:0] will have
no function
,
but will be writeable and readable.
CSR4[15:10], CSR4[7:6] and CSR4[3:2] will function as
defined in the CSR4 section. TMD1[29] becomes NO_FCS.
02
PCnet-32
1
1
ALL CSR4 bits will function as defined in the CSR4 section.
TMD1[29] functions as ADD_FCS
All other
combinations
Reserved
Undefined
INTSEL[1:0]
JTAGSEL
Selected
interrupt Pin
00
0
INTR1
01
0
INTR2
10
0
INTR3
11
0
INTR4
00
1
INTR1
01
1
INTR2
10
1
INTR1
11
1
INTR2
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PDF描述
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