參數(shù)資料
型號(hào)： MII-300GP
元件分類(lèi)： 微控制器/微處理器
英文描述： 32-BIT, 300 MHz, MICROPROCESSOR, PGA296
封裝： SPGA, 296 PIN
文件頁(yè)數(shù)： 242/257頁(yè)
文件大?。?/td> 1234K
代理商： MII-300GP
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2-54
PRELIMINARY
Memory Addressing Methods
Advanci ng the S tandar ds
Table 2-27.
Directory and Page Table Entry (DTE and PTE) Bit Definitions
BIT POSITION
FIELD NAME
DESCRIPTION
31-12
BASE
ADDRESS
Specifies the base address of the page or page table.
11-9
--
Undefined and available to the programmer.
8-7
--
Reserved and not available to the programmer.
6
D
Dirty Bit. If set, indicates that a write access has occurred to the page (PTE only,
undefined in DTE).
5
A
Accessed Flag. If set, indicates that a read access or write access has occurred
to the page.
4
PCD
Page Caching Disable Flag. If set, indicates that the page is not cacheable in
the on-chip cache.
3
PWT
Page Write-Through Flag. If set, indicates that writes to the page or page tables
that hit in the on-chip cache must update both the cache and external memory.
2
U/S
User/Supervisor Attribute. If set (user), page is accessible at privilege level 3. If
clear (supervisor), page is accessible only when CPL
≤ 2.
1
W/R
Write/Read Attribute. If set (write), page is writable. If clear (read), page is
read only.
0
P
Present Flag. If set, indicates that the page is present in RAM memory, and
validates the remaining DTE/PTE bits. If clear, indicates that the page is not
present in memory and the remaining DTE/PTE bits can be used by the
programmer.
For a TLB hit, the TLB eliminates accesses to
external directory and page tables.
The L1 TLB is a small cache optimized for speed
whereas the L2 TLB is a much larger cache opti-
mized for capacity. The L2 TLB is a proper
superset of the L1 TLB.
The TLB must be flushed by the software when
entries in the page tables are changed. Both the
L1 and L2 TLBs are flushed whenever the CR3
register is loaded. A particular page can be
flushed from the TLBs by using the INVLPG
instruction.
2.12.4.1 Translation Lookaside
Buffer Testing
The L1 and L2 Translation Lookaside Buffers
(TLBs) can be tested by writing, then reading
from the same TLB location. The operation to be
performed is determined by the command
(CMD) field (Table 2-28, Page 2-54) in the TR6
register.
Table 2-28. CMD Field
CMD
OPERATION
LINEAR
ADDRESS BITS
x00
Write to L1
15 - 12
x01
Write to L2
17 - 12
010
Read from L1 X port
15 -12
011
Read from L2 X port
17 -12
110
Read from L1 Y port
15 - 12
110
Read from L2 Y port
17 - 12
相關(guān)PDF資料
PDF描述
MJ10000 20 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AA
MJ1000 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA
MJ1001 10 A, 80 V, NPN, Si, POWER TRANSISTOR, TO-204AA
MJ10022 40 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AE
MJ3000 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MII400-12E4 功能描述:分立半導(dǎo)體模塊 IGBT MODULE 1200V, 400A RoHS:否 制造商:Infineon Technologies 產(chǎn)品:Thyristor Power Modules 類(lèi)型:Phase Controls 安裝風(fēng)格:Screw 封裝 / 箱體:DT61 封裝:
MII-400GP 95MHZ2.2V 制造商:CYRIX 功能描述:
MII75-12A3 功能描述:分立半導(dǎo)體模塊 75 Amps 1200V RoHS:否 制造商:Infineon Technologies 產(chǎn)品:Thyristor Power Modules 類(lèi)型:Phase Controls 安裝風(fēng)格:Screw 封裝 / 箱體:DT61 封裝:
MI-IAM 制造商:VICOR 制造商全稱(chēng):Vicor Corporation 功能描述:Military Input Attenuator Modules
MIIC5271 制造商:MICREL 制造商全稱(chēng):Micrel Semiconductor 功能描述:UCAP NEGATIVE LOW DROPOUT REGULATOR
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