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參數(shù)資料
| 型號(hào)： | MII-300GP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 300 MHz, MICROPROCESSOR, PGA296 |
| 封裝： | SPGA, 296 PIN |
| 文件頁數(shù)： | 24/257頁 |
| 文件大?。?/td> | 1234K |
| 代理商： | MII-300GP |
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x
PRELIMINARY
List of Tables and Figures
Advanci ng the S tandar ds
Table 2-27. Directory and Page Table Entry (DTE and PTE) Bit Definitions . . . . . . . . . . . . . . . . . 2-54
Table 2-28. CMD Field . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-54
Table 2-29. TLB Test Register Bit Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-56
Table 2-30. Cache Test Register Bit Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-59
Table 2-31. Cache Locking Operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-61
Table 2-32. Interrupt Vector Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-65
Table 2-33. Interrupt and Exception Priorities. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-67
Table 2-34. Exception Changes in Real Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-68
Table 2-35. Error Code Bit Definitions. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-69
Table 2-36. SMM Memory Space Header . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-73
Table 2-37. SMHR Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-74
Table 2-38. SMM Instruction Set . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-75
Table 2-39. Requirements for Recognizing SMI# and SMINT . . . . . . . . . . . . . . . . . . . . . . . . 2-76
Table 2-40. Descriptor Types Used for Control Transfer . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-84
Table 2-41. FPU Status Register Bit Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-87
Table 2-42. FPU Mode Control Register Bit Definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-88
Table 2-43. Saturation Limits . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-90
Table 3-1.
M II CPU Signals Sorted by Signal Name . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-2
Table 3-2.
Clock Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-7
Table 3-3.
Pins Sampled During RESET . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-7
Table 3-4.
Signal States During RESET . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-8
Table 3-5.
Byte Enable Signal to Data Bus Byte Correlation. . . . . . . . . . . . . . . . . . . . . . . . . 3-9
Table 3-6.
Parity Bit to Data Byte Correlation. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-10
Table 3-7.
Bus Cycle Types. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-12
Table 3-8.
Effects of WB/WT# on Cache Line State. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-16
Table 3-9.
Signal States During Bus Hold. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-17
Table 3-10. Signal States During Suspend Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-21
Table 3-11. M II CPU Bus States. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-24
Table 3-12. Bus State Transitions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-26
Table 3-13.
“1+4” Burst Address Sequences. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-33
Table 3-14. Linear Burst Address Sequences. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-34
Table 4-1.
Pins Connected to Internal Pull-Up and Pull-Down Resistors . . . . . . . . . . . . . . . . . . 4-1
LIST OF TABLES (Continued)
Table Name
Page Number
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MJ10000 | 20 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ1000 | 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ1001 | 10 A, 80 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ10022 | 40 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AE |
| MJ3000 | 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MII400-12E4 | 功能描述:分立半導(dǎo)體模塊 IGBT MODULE 1200V, 400A RoHS:否 制造商:Infineon Technologies 產(chǎn)品:Thyristor Power Modules 類型:Phase Controls 安裝風(fēng)格:Screw 封裝 / 箱體:DT61 封裝: |
| MII-400GP 95MHZ2.2V | 制造商:CYRIX 功能描述: |
| MII75-12A3 | 功能描述:分立半導(dǎo)體模塊 75 Amps 1200V RoHS:否 制造商:Infineon Technologies 產(chǎn)品:Thyristor Power Modules 類型:Phase Controls 安裝風(fēng)格:Screw 封裝 / 箱體:DT61 封裝: |
| MI-IAM | 制造商:VICOR 制造商全稱:Vicor Corporation 功能描述:Military Input Attenuator Modules |
| MIIC5271 | 制造商:MICREL 制造商全稱:Micrel Semiconductor 功能描述:UCAP NEGATIVE LOW DROPOUT REGULATOR |
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