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參數(shù)資料
| 型號： | MII-300GP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 300 MHz, MICROPROCESSOR, PGA296 |
| 封裝： | SPGA, 296 PIN |
| 文件頁數(shù)： | 197/257頁 |
| 文件大?。?/td> | 1234K |
| 代理商： | MII-300GP |
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2-13
2
PRELIMINARY
System Register Set
2.4.1
Control Registers
The Control Registers (CR0, CR2, CR3 and
CR4), are shown in Figure 2-6. (These registers
should not be confused with the CCRn registers.)
The CR0 register contains system control bits
which configure operating modes and indicate
the general state of the CPU. The lower 16 bits
of CR0 are referred to as the Machine Status
Word (MSW). The CR0 bit definitions are
described in Table 2-4 and Table 2-5 (Page
2-14). The reserved bits in CR0 should not be
modified.
When paging is enabled and a page fault is gen-
erated, the CR2 register retains the 32-bit linear
address of the address that caused the fault.
When a double page fault occurs, CR2 contains
the address for the second fault. Register CR3
contains the 20 most significant bits of the
physical base address of the page directory. The
page directory must always be aligned to a
4-KByte page boundary, therefore, the lower 12
bits of CR3 are not required to specify the base
address.
CR3 contains the Page Cache Disable (PCD) and
Page Write Through (PWT) bits. During bus
cycles that are not paged, the state of the PCD
bit is reflected on the PCD pin and the PWT bit
is driven on the PWT pin. These bus cycles
include interrupt acknowledge cycles and all
bus cycles, when paging is not enabled. The
PCD pin should be used to control caching in an
external cache. The PWT pin should be used to
control write policy in an external cache.
Control register CR4 (Table 2-6, Page 2-15)
controls usage of the Time Stamp Counter
Instruction, Debugging Extensions, Page Global
Enable and the RDPMC instruction.
Figure 2-6. Control Registers
PAGE FAULT LINEAR ADDRESS
17 495 00
MSW
PAGE DIRECTORY BASE REGISTER (PDBR)
RESV.
RESERVED
31
30
PP
1
RESERVED
T
EM P
AW
P CN
W
T
C
D
SM P
E
M
P
0
1
2
3
4
16
18
31 30 29
G DW
N
E
5
CR3
CR2
CR0
CR4
6
7
8
11
12
2
D
E
P
E
C
E
P
G
D
T
S
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PDF描述 |
|---|---|
| MJ10000 | 20 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
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