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參數資料
| 型號： | MII-300GP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 300 MHz, MICROPROCESSOR, PGA296 |
| 封裝： | SPGA, 296 PIN |
| 文件頁數： | 209/257頁 |
| 文件大小： | 1234K |
| 代理商： | MII-300GP |
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2-24
PRELIMINARY
System Register Set
Advanci ng the S tandar ds
2.4.4
M II Configuration
Registers
The M II configuration registers are used to
enable features in the M II CPU. These registers
assign non-cached memory areas, set up SMM,
provide CPU identification information and
control various features such as cache write
policy, and bus locking control. There are four
groups of registers within the M II configura-
tion register set:
7 Configuration Control Registers (CCRx)
8 Address Region Registers (ARRx)
8 Region Control Registers (RCRx)
Access to the configuration registers is achieved
by writing the register index number for the
configuration register to I/O port 22h. I/O port
23h is then used for data transfer.
Each I/O port 23h data transfer must be pre-
ceded by a valid I/O port 22h register index
selection. Otherwise, the current 22h, and the
second and later I/O port 23h operations com-
municate through the I/O port to produce
external I/O cycles. All reads from I/O port 22h
produce external I/O cycles. Accesses that hit
within the on-chip configuration registers do
not generate external I/O cycles.
After reset, configuration registers with indexes
C0-CFh and FC-FFh are accessible. To prevent
potential conflicts with other devices which
may use ports 22 and 23h to access their regis-
ters, the remaining registers (indexes D0-FBh)
are accessible only if the MAPEN(3-0) bits in
CCR3 are set to 1h. See Figure 2-16 (Page
2-29) for more information on the
MAPEN(3-0) bit locations.
If MAPEN[3-0] = 1h, any access to indexes in
the range 00-FFh will not create external I/O
bus cycles. Registers with indexes C0-CFh,
FC- FFh are accessible regardless of the state of
MAPEN[3 -0]. If the register index number is
outside the C0 -CFh or FC-FFh ranges, and
MAPEN[3 -0] are set to 0h, external I/O bus
cycles occur. Table 2-11 (Page 2-25) lists the
MAPEN[3-0] values required to access each M
II configuration register. All bits in the config-
uration registers are initialized to zero following
reset unless specified otherwise.
2.4.4.1
Configuration Control
Registers
(CCR0 - CCR6) control several functions,
including non-cacheable memory, write-back
regions, and SMM features. A list of the config-
uration registers is listed in Table 2-11 (Page
2-25). The configuration registers are described
in greater detail in the following pages.
相關PDF資料 |
PDF描述 |
|---|---|
| MJ10000 | 20 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ1000 | 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ1001 | 10 A, 80 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ10022 | 40 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AE |
| MJ3000 | 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MII400-12E4 | 功能描述:分立半導體模塊 IGBT MODULE 1200V, 400A RoHS:否 制造商:Infineon Technologies 產品:Thyristor Power Modules 類型:Phase Controls 安裝風格:Screw 封裝 / 箱體:DT61 封裝: |
| MII-400GP 95MHZ2.2V | 制造商:CYRIX 功能描述: |
| MII75-12A3 | 功能描述:分立半導體模塊 75 Amps 1200V RoHS:否 制造商:Infineon Technologies 產品:Thyristor Power Modules 類型:Phase Controls 安裝風格:Screw 封裝 / 箱體:DT61 封裝: |
| MI-IAM | 制造商:VICOR 制造商全稱:Vicor Corporation 功能描述:Military Input Attenuator Modules |
| MIIC5271 | 制造商:MICREL 制造商全稱:Micrel Semiconductor 功能描述:UCAP NEGATIVE LOW DROPOUT REGULATOR |
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