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參數(shù)資料
| 型號： | MII-300GP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 300 MHz, MICROPROCESSOR, PGA296 |
| 封裝： | SPGA, 296 PIN |
| 文件頁數(shù)： | 10/257頁 |
| 文件大?。?/td> | 1234K |
| 代理商： | MII-300GP |
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2-76
PRELIMINARY
System Management Mode
Advanci ng the S tandar ds
System Management Mode
2-76
The SMM instructions listed in Table 2-38,
(except the SMINT instruction) can be executed
only if:
1)
ARR3 Size > 0
2)
Current Privilege Level =0
3)
SMAC bit is set or the CPU is executing
an SMI service routine.
4)
USE_SMI (CCR1- bit 1) = 1
5)
SM3 (CCR1-bit 7) = 1
If the above conditions are not met and an
attempt is made to execute an SVDC, RSDC,
SVLDT, RSLDT, SVTS, RSTS, SMINT, RSM,
RDSHR, or WDSHR instruction, an invalid
opcode exception is generated. These instruc-
tions can be executed outside of defined SMM
space provided the above conditions are met.
The SMINT instruction allows software entry
into SMM. The SVDC, RSDC, SVLDT, RSLDT,
SVTS and RSTS instructions save or restore 80
bits of data, allowing the saved values to include
the hidden portion of the register contents.
The WRSHR instruction loads the contents of
either a 32-bit memory operand or a 32-bit
register operand into the SMHR pointer register
based on the value of the mod r/m instruction
byte. Likewise the RDSHR instruction stores the
contents of the SMHR pointer register to either
a 32 bit memory operand or a 32 bit register
operand based on the value of the mod r/m
instruction byte.
2.15.4 SMM Operation
This section details the SMM operations.
Entering SMM
Entering SMM requires the assertion of the
SMI# pin or execution of an SMINT instruction.
SMI interrupts have higher priority than any
interrupt including NMI interrupts.
For the SMI# or SMINT instruction to be recog-
nized, the following configuration register bits
must be set as shown in Table 2-39.
Upon entry into SMM, after the SMM header has
been saved, the CR0, EFLAGS, and DR7 regis-
ters are set to their reset values. The Code
Segment (CS) register is loaded with the base,
as defined by the ARR3 register, and a limit of 4
GBytes. The SMI service routine then begins
execution at the SMM base address in real mode.
Table 2-39. Requirements for
Recognizing SMI# and SMINT
REGISTER (Bit)
SMI#
SMINT
SMI
CCR1 (1)
1
SMAC
CCR1 (2)
0
1
ARR3
SIZE (3-0)
> 0
SM3
CCR1 (7)
1
相關PDF資料 |
PDF描述 |
|---|---|
| MJ10000 | 20 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ1000 | 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ1001 | 10 A, 80 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
| MJ10022 | 40 A, 350 V, NPN, Si, POWER TRANSISTOR, TO-204AE |
| MJ3000 | 10 A, 60 V, NPN, Si, POWER TRANSISTOR, TO-204AA |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| MII-400GP 95MHZ2.2V | 制造商:CYRIX 功能描述: |
| MII75-12A3 | 功能描述:分立半導體模塊 75 Amps 1200V RoHS:否 制造商:Infineon Technologies 產(chǎn)品:Thyristor Power Modules 類型:Phase Controls 安裝風格:Screw 封裝 / 箱體:DT61 封裝: |
| MI-IAM | 制造商:VICOR 制造商全稱:Vicor Corporation 功能描述:Military Input Attenuator Modules |
| MIIC5271 | 制造商:MICREL 制造商全稱:Micrel Semiconductor 功能描述:UCAP NEGATIVE LOW DROPOUT REGULATOR |
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