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參數(shù)資料
| 型號(hào)： | POMAP5912ZDY |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | CONN DIN PLUG VERT 96POS 3ROWS |
| 中文描述： | 應(yīng)用處理器 |
| 文件頁數(shù)： | 97/254頁 |
| 文件大?。?/td> | 2467K |
| 代理商： | POMAP5912ZDY |
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Functional Overview
97
December 2003 Revised March 2005
SPRS231D
3.1
Functional Block Diagram Features
The OMAP5912 devices include the following functional blocks:
ARM926EJS megacell including:
ARM926EJS, supporting the operating system
MMU with translation lookaside buffer (TLBx)
L1 16K-byte, four-way, set-associative instruction cache
L1 8K-byte, four-way, set-associative data cache with write buffer
MPU interrupt handler level 1
Embedded trace macrocell module, ETM version 2.a in a 13-bit mode configuration or in a 17-bit
demultiplexed mode configuration
C55x DSP subsystem:
Embedded ICE emulator interface through JTAG port
TMS320C55x (C55x) DSP rev 2.1
L1 cache (24K bytes)
16K-byte, two-way, set-associative instruction cache
2
×
4K-byte RAM set for instruction
DARAM 64K-byte, zero-wait state, 32-bit organization
SARAM 96K-byte, zero-wait state, 32-bit organization
PDROM (32K bytes)
DMA controller: Six physical channels, five ports
DSP trace module
Hardware accelerators motion estimation (ME), discrete/inverse discrete cosine transform
(DCT/IDCT), and pixel interpolation (PI)
DSP interrupt handler level 1 in the C55x DSP core
DSP MMU
DSP level 2 interrupt handler enabling connection to 16 additional interrupt lines outside OMAP. The
priority of each interrupt line is controlled by software.
DSP interrupt interface enabling connection to the interrupt lines coming out of the level 2 interrupt handler
and the interrupt lines requiring higher priority. The outcome interrupt of this module is then connected
to the DSP megacell to be processed by the DSP. This module mainly ensures that all interrupts going
to the DSP megacell are level-sensitive.
DSP peripherals:
3
×
16-bit DSP private timers
1
×
16-bit DSP private watchdog
Mailboxes:
Four mailboxes are implemented:
Two read/write accessible by MPU, read-only by the DSP
Two read/write accessible by the DSP, read-only by the MPU
Each mailbox is implemented with 2
×
16-bit registers. When a write is done into a register by one
processor, it generates an interrupt; this interrupt is released by the read access of the other processor.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| PPB3781 | LOW VOLTAGE SPEECH CIRCUIT |
| PQ030EZ01Z | DEVICE SPECIFICATION FOR VOLTAGE REGULATOR |
| PQ030EZ01ZP | DEVICE SPECIFICATION FOR VOLTAGE REGULATOR |
| PQ030EZ01ZZ | DEVICE SPECIFICATION FOR VOLTAGE REGULATOR |
| PQ033EZ01ZP | DEVICE SPECIFICATION FOR VOLTAGE REGULATOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| POMAP5912ZDYA | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Texas Instruments 功能描述:POMAP5912, BGA 19X19 (-40/85 AMBIENT ) - Trays |
| POMAP710AGZG | 制造商:Texas Instruments 功能描述: |
| POMONA 5514-RS | 制造商:Pomona 功能描述:CLIP KIT SOIC |
| POMONA5514-RS | 制造商:Pomona Electronics 功能描述:SOIC SMT clip kit |
| PON15 | 功能描述:保險(xiǎn)絲 NRN 15 A CART RoHS:否 制造商:Littelfuse 產(chǎn)品:Surface Mount Fuses 電流額定值:0.5 A 電壓額定值:600 V 保險(xiǎn)絲類型:Fast Acting 保險(xiǎn)絲大小/組:Nano 尺寸:12.1 mm L x 4.5 mm W 安裝風(fēng)格: 端接類型:SMD/SMT 系列:485 |
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