參數資料
型號： POMAP5912ZDY
廠商： Texas Instruments, Inc.
英文描述： CONN DIN PLUG VERT 96POS 3ROWS
中文描述： 應用處理器
文件頁數： 202/254頁
文件大?。?/td> 2467K
代理商： POMAP5912ZDY
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Electrical Specifications
202
December 2003 Revised March 2005
SPRS231D
Table 510. EMIFS/NOR Flash Interface Switching Characteristics
NO
PARAMETER
DV
DD5
= 1.8 V/2.75 V/3.3 V
NOMINAL
UNIT
MIN
MAX
F1
t
w(CSV)
FLASH.CSx low duration—Read operation
Async modes
A 7
A + 7
ns
F3
t
d(CSV-ADIV)
Delay time, FLASH.CSx low to FLASH.ADV high
Async modes
B 8.2
B + 4.53
ns
Sync modes
M 8.2
M + 4.53
F4
t
d(CSV-OEIV)
Delay time, FLASH.CSx low to FLASH.OE high
Async modes
C 7.3
C + 4.11
ns
F9
t
d(CSV-AV)
Delay time, FLASH.CSx low to address valid
Async and
sync modes
8.7
7.8
ns
F10
t
d(CSV-BEV)
Delay time, FLASH.CSx low to FLASH.BEx valid
Async and
sync modes
5.4
3.9
ns
F11
t
d(CSIV-BEIV)
Delay time, FLASH.CSx high to FLASH.BEx invalid
Async and
sync modes
5.4
3.9
ns
F12
t
d(CSV-ADV)
Delay time, FLASH.CSx low to FLASH.ADV low
Async and
sync modes
8.2
4.53
ns
F13
t
d(CSV-OEV)
Delay time, FLASH.CSx low to FLASH.OE low
Async and
sync modes
7.3
4.11
ns
F14
t
d(CSIV-ADIV)
Delay time, FLASH.CSx high to FLASH.ADV high
Async modes
8.2
4.53
ns
F15
t
d(CSIV-OEIV)
Delay time, FLASH.CSx high to FLASH.OE high
Async and
sync modes
7.3
4.11
ns
F16
t
w(CSIV)
t
w(AV)
t
w(AV)
t
w(CSV)
t
w(WEV)
t
d(CSV-WEV)
t
d(CSIV-WEIV)
FLASH.CSx high duration—Read operation
Address valid duration—1
st
access
Address valid duration—2
nd
, 3
rd
, and 4
th
accesses
Async modes
J 7
J + 7
ns
F19
Async modes
A 5.6
A + 6.25
ns
F20
Async modes
D 5.6
D + 6.25
ns
F23
FLASH.CSx low duration—Write operation
Async modes
E 7
E + 7
ns
F23/2
FLASH.WE low duration—Write operation
Async modes
G 1.4
G + 1.4
ns
F25
Delay time, FLASH.CSx low to FLASH.WE low
Async modes
F 6.6
F + 3.29
ns
F27
Delay time, FLASH.CSx high to FLASH.WE high
Async modes
H 6.6
H + 3.29
ns
F27/2
t
d(WEIV-AIV)
Delay time, FLASH.WE high to FLASH.A[25:1]
invalid
Async modes
P 3.5
P + 6.3
ns
F27/3
t
d(WEIV-DIV)
Delay time, FLASH.WE high to FLASH.D[15:0]
invalid
Async modes
P 4.4
P + 1.812
ns
F28
t
d(CSV-DLZ)
t
d(DV-CSV)
t
d(DIV-CSIV)
t
d(DHZ-CSIV)
Delay time, FLASH.CSx low to data bus driven
Async modes
13.9
0.4
ns
F29
Delay time, data bus valid to FLASH.CSx low
Async modes
12.9
2.19
ns
F30
Delay time, data bus invalid to FLASH.CSx high
Async modes
12.9
2.19
ns
F31
Delay time, data bus high Z to FLASH.CSx high
Async modes
13.9
0.4
ns
The maximum EMIFS/flash clock rate is limited to the maximum traffic controller clock rate for the OMAP5912, provided all EMIFS/flash timing
constraints are met.
A = (RDWST + 2) * EMIFS clock period (Ref_clk)
B = (ADVHOLD + 1) * EMIFS clock period (Ref_clk)
C = (RDWST – OEHOLD +2) * EMIFS clock period (Ref_clk)
D = (PGWST + 1) * EMIFS clock period (Ref_clk)
E = (WRWST + WELEN + 3) * EMIFS clock period (Ref_clk)
F = (WRWST + 1) * EMIFS clock period (Ref_clk)
G = (WELEN + 1) * EMIFS clock period (Ref_clk)
H = 1 * EMIFS clock period (Ref_clk)
I = 0.5 * EMIFS clock period (Ref_clk)
J = (BTWST + 1) * EMIFS clock period (Ref_clk)
K = OESETUP * EMIFS clock period (Ref_clk)
L = OEHOLD * EMIFS clock period (Ref_clk)
M = (ADVHOLD + 1) * EMIFS clock period (Ref_clk) + 1 TC_CK period
相關PDF資料
PDF描述
PPB3781 LOW VOLTAGE SPEECH CIRCUIT
PQ030EZ01Z DEVICE SPECIFICATION FOR VOLTAGE REGULATOR
PQ030EZ01ZP DEVICE SPECIFICATION FOR VOLTAGE REGULATOR
PQ030EZ01ZZ DEVICE SPECIFICATION FOR VOLTAGE REGULATOR
PQ033EZ01ZP DEVICE SPECIFICATION FOR VOLTAGE REGULATOR
相關代理商/技術參數
參數描述
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