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參數(shù)資料
| 型號(hào)： | POMAP5912ZDY |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | CONN DIN PLUG VERT 96POS 3ROWS |
| 中文描述： | 應(yīng)用處理器 |
| 文件頁(yè)數(shù)： | 78/254頁(yè) |
| 文件大小： | 2467K |
| 代理商： | POMAP5912ZDY |
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Introduction
78
December 2003 Revised March 2005
SPRS231D
Table 25. Signal Descriptions (Continued)
SIGNAL
TYPE
DESCRIPTION
ZZG
BALL#
ZDY
BALL#
EXTERNAL MEMORY INTERFACE SLOW (EMIFS) FLASH AND ASYNCHRONOUS MEMORY INTERFACE
FLASH.A[25:1]
F3 J4
J2 H2
H5 F4
H4 H3
G6 G5
G2 G4
G3 F5
F1 F2
E1 D1
E2 C1
D2 E3
E4 C2
D3
E1 L7
K3 K4
L8 F2
J3 J4
J2 K7
H3 H4
K8 G2
G3 G4
F3 J7
E3 F4
D2 E4
C1 D3
J8
EMIFS address bus. Address output bus for all EMIFS accesses.
O
FLASH.D[15:0]
N4 R1
P1 K7
M3 M4
N2 L5
N1 K6
L4 M2
J7 L2
M1 L1
V3 T4
U3 U1
P8 T3
T2 R4
R3 R2
P7 P4
P2 N7
N2 N4
EMIFS data bus. Bidirectional 16-bit data bus used to transfer read and write
data during EMIFS accesses.
The 16-bit data bus becomes address/data in case the EMIFS is configured
in address/data multiplexed mode.
I/O
FLASH.CLK
K1
N3
Flash clock. Clock output that is active during synchronous modes of flash
operation for synchronous burst flash memories.
O
FLASH.RDY
L6
V2
Flash ready. Active-high ready input used to suspend the flash interface
when the external memory or asynchronous device is not ready to continue
the current cycle.
I
FLASH.ADV
H6
L4
Flash address valid. Active-low control signal used to indicate a valid
address is present on the FLASH.A[25:1] bus.
O
FLASH.BAA
J8
M4
Flash burst advance acknowledge. Active-low control signal used with
Advanced Micro Devices
E burst flash.
O
FLASH.BE[1:0]
K2 J1
M8 L3
Flash byte enables. Active-low byte enable signals used to perform
byte-wide accesses to memories or devices that support byte enables.
O
FLASH.CS0
J5
M7
Flash chip-select bit 0
O
FLASH.CS1
J3
M3
Flash chip-select bit 1
O
FLASH.CS1L
J3
M3
Lower half of FLASH.CS1 address range
O
FLASH.CS1U
T1
Y1
Upper half of FLASH.CS1 address range
O
FLASH.CS2
J8
M4
Flash chip-select bit 2
O
FLASH.CS2L
J8
M4
Lower half of FLASH.CS2 address range
O
FLASH.CS2U
K3
P3
Upper half of FLASH.CS2 address range
O
FLASH.CS2UOE
J1
L3
interface with external flash.
O
K1
N3
FLASH.CS2U gated with FLASH.OE. Output enable if EMIFS is used to
FLASH.CS2UWE
K2
M8
interface with external flash.
O
N3
W1
FLASH.CS2U gated with FLASH.WE. Write enable if EMIFS is used to
FLASH.CS3
J6
N8
Flash chip-select bit 3. If MPU_BOOT is high and the device is an emulation
device, select external boot memory.
O
I = Input, O = Output, Z = High-Impedance
Advanced Micro Devices is a trademark of Advanced Micro Devices, Inc.
相關(guān)PDF資料 |
PDF描述 |
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| PPB3781 | LOW VOLTAGE SPEECH CIRCUIT |
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| PQ030EZ01ZP | DEVICE SPECIFICATION FOR VOLTAGE REGULATOR |
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參數(shù)描述 |
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