參數(shù)資料
型號： POMAP5912ZDY
廠商： Texas Instruments, Inc.
英文描述： CONN DIN PLUG VERT 96POS 3ROWS
中文描述： 應用處理器
文件頁數(shù)： 75/254頁
文件大小： 2467K
代理商： POMAP5912ZDY
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Introduction
75
December 2003 Revised March 2005
SPRS231D
Table 24. ZZG Package Terminal Characteristics (Continued)
ZZG
BALL
NO.
SUPPLY
RESET
STATE
#
OTHER
BUFFER
STRENGTH
§
PULLUP/
PULLDN
MUX CTRL SETTING
TYPE
SIGNAL NAME
E3
FLASH.A[7]
O
Reg12[8:6] = 000
PU20,
PD20
2 mA (Lv)
3 mA (Hv)
A, G1
0
DV
DD5
F4
FLASH.A[6]
O
Reg12[11:9] = 000
PU20,
PD20
2 mA (Lv)
3 mA (Hv)
A, G1
0
DV
DD5
D2
FLASH.A[5]
O
Reg12[14:12] = 000
PU20,
PD20
2 mA (Lv)
3 mA (Hv)
A, G1
0
DV
DD5
E4
FLASH.A[4]
O
Reg12[17:15] = 000
PU20,
PD20
2 mA (Lv)
3 mA (Hv)
A, G1
0
DV
DD5
C1
FLASH.A[3]
O
Reg12[20:18] = 000
PU20,
PD20
2 mA (Lv)
3 mA (Hv)
A, G1
0
DV
DD5
D3
FLASH.A[2]
O
Reg12[23:21] = 000
PU20,
PD20
2 mA (Lv)
3 mA (Hv)
A, G1
0
DV
DD5
J8
FLASH.A[1]
O
Reg12[26:24] = 000
2 mA (Lv)
3 mA (Hv)
A, G1
0
DV
DD5
V3 T4
U3 U1
P8 T3
T2 R4
R3 R2
P7 P4
P2 N7
N2 N4
FLASH.D[15:0]
I/O
NA
2 mA (Lv)
3 mA (Hv)
A, K
0
DV
DD5
N3
FLASH.CLK
O
Reg10[23:21] = 000
3 mA (Hv)
A, K, G1
0
DV
DD5
FLASH.CS2UOE
O
Reg10[23:21] = 001
2 mA (Lv)
V2
FLASH.RDY
I
RegF[29:27] = 000
PD20
3 mA (Hv)
A, F
Input
DV
DD5
GPIO10
I/O
RegF[29:27] = 001
PU100,
2 mA (Lv)
L4
FLASH.ADV
O
NA
2 mA (Lv)
3 mA (Hv)
A
1
DV
DD5
M4
FLASH.CS2
O
RegD[8:6] = 000
3 mA (Hv)
A
1
DV
DD5
FLASH.BAA
O
RegD[8:6] = 000
2 mA (Lv)
FLASH.CS2L
O
RegD[8:6] = 000
M7
GPIO62
I/O
Reg10[2:0] = 000
3 mA (Hv)
A, F, G1
Input
DV
DD5
FLASH.CS0
O
Reg10[2:0] = 001
2 mA (Lv)
M3
FLASH.CS1
O
Reg10[29:27] = 000
3 mA (Hv)
A
1
DV
DD5
FLASH.CS1L
O
Reg10[29:27] = 001
2 mA (Lv)
I = Input, O = Output, Z = High-Impedance
PD20 = 20-
μ
A internal pulldown, PD100=100-
μ
A internal pulldown, PU20 = 20-
μ
A internal pullup, PU100 = 100-
μ
A internal pullup. Pullup or
pulldown can be enabled or disabled by software.
§
Lv = Low voltage (1.65 V), Hv = High voltage (2.5 V)
A = Standard LVCMOS input/output
G1 = Terminal may be gated by BFAIL
B = SUBLVDS input/ouput
G2 = Terminal may be gated by GPIO9 and MPUIO3
C = USB transceiver input/ouput
G3 = Terminal my be gated by BFAIL and OMAP5912 Internal Reset
D = I
2
C input/output buffers
H1 = Terminal may be 3-stated by BFAIL input
E = Analog oscillator terminals
H3 = MCSI1.DOUT pin can be forced into a high-impedance
F = Boundary-scannable terminal
state by the OMAP5912 HIGH_IMP3 control bit
K = Output buffer includes a serial resistor of 20
to match with PCB line impedance and ensure proper signal integrity
#
Z = High-Impedance, LZ = Low-Impedance (pin is driven), 1 = Output driven high, 0 = Output driven low
NOTES:
3. NA denotes no multiplexing on the ball
4. ‘Regx’ denotes the terminal multiplexing register that controls the specified terminal where Regx = FUNC_MUX_CTRL_x
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PDF描述
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PON15 功能描述:保險絲 NRN 15 A CART RoHS:否 制造商:Littelfuse 產(chǎn)品:Surface Mount Fuses 電流額定值:0.5 A 電壓額定值:600 V 保險絲類型:Fast Acting 保險絲大小/組:Nano 尺寸:12.1 mm L x 4.5 mm W 安裝風格: 端接類型:SMD/SMT 系列:485
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