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參數(shù)資料
| 型號： | POMAP5912ZDY |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | CONN DIN PLUG VERT 96POS 3ROWS |
| 中文描述： | 應用處理器 |
| 文件頁數(shù)： | 39/254頁 |
| 文件大?。?/td> | 2467K |
| 代理商： | POMAP5912ZDY |
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Introduction
39
December 2003 Revised March 2005
SPRS231D
2.3
Terminal Characteristics and Multiplexing
Table 23 describes terminal characteristics and the signals multiplexed on each ball for the ZDY package.
Table 24 describes terminal characteristics and the signals multiplexed on each ball for the ZZG package.
The table column headers are explained below:
BALL NO.:
The package ball number.
SIGNAL NAME:
The names of all the signals that are multiplexed on each ball.
TYPE:
The signal direction.
MUX CTRL SETTING:
Shows control of multiplexing modes.
PULLUP/PULLDN:
Denotes the presence of an internal pullup or pulldown. Pullups and pulldowns can
be enabled or disabled via software.
BUFFER STRENGTH:
Drive strength of the associated output buffer.
OTHER:
Contains various terminal information, such as buffer type, boundary scan capability, and
gating/inhibit functionality.
RESET STATE:
The state of the terminal at reset.
SUPPLY:
The voltage supply which powers the terminal’s I/O buffers.
NOTE:
Care must be taken to avoid assigning multiple balls to the same signal. Violations may
cause unexpected results.
Table 23. ZDY Package Terminal Characteristics
ZDY
BALL
NO.
SIGNAL NAME
TYPE
MUX CTRL SETTING
PULLUP/
PULLDN
BUFFER
STRENGTH
§
OTHER
RESET
STATE
#
SUPPLY
E7
SDRAM.CS
O
NA
2 mA (Lv)
3 mA (Hv)
A
1
DV
DD4
A12
SDRAM.DQSH
I/O
NA
2 mA (Lv)
3 mA (Hv)
A, K
0
DV
DD4
A2
SDRAM.DQSL
I/O
NA
2 mA (Lv)
3 mA (Hv)
A, K
0
DV
DD4
D5
SDRAM.CAS
O
NA
2 mA (Lv)
3 mA (Hv)
A
1
DV
DD4
D4
SDRAM.RAS
O
NA
2 mA (Lv)
3 mA (Hv)
A
1
DV
DD4
C7
SDRAM.DQML
O
NA
2 mA (Lv)
3 mA (Hv)
A, K
0
DV
DD4
A8
SDRAM.DQMU
O
NA
2 mA (Lv)
3 mA (Hv)
A, K
0
DV
DD4
I = Input, O = Output, Z = High-Impedance
PD20 = 20-
μ
A internal pulldown, PD100=100-
μ
A internal pulldown, PU20 = 20-
μ
A internal pullup, PU100 = 100-
μ
A internal pullup. Pullup or
pulldown can be enabled or disabled by software.
§
A = Standard LVCMOS input/output
G1 = Terminal may be gated by BFAIL
B = SUBLVDS input/ouput
G2 = Terminal may be gated by GPIO9 and MPUIO3
C = USB transceiver input/ouput
G3 = Terminal my be gated by BFAIL and OMAP5912 Internal Reset
D = I
2
C input/output buffers
H1 = Terminal may be 3-stated by BFAIL input
E = Analog oscillator terminals
H3 = MCSI1.DOUT pin can be forced into a high-impedance
F = Boundary-scannable terminal
state by the OMAP5912 HIGH_IMP3 control bit
K = Output buffer includes a serial resistor of 20
to match with PCB line impedance and ensure proper signal integrity
#
Z = High-Impedance, LZ = Low-Impedance (pin is driven), 1 = Output driven high, 0 = Output driven low
NOTES:
3. NA denotes no multiplexing on the ball
4. ‘Regx’ denotes the terminal multiplexing register that controls the specified terminal where Regx = FUNC_MUX_CTRL_x
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