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參數(shù)資料
| 型號： | MT8LLN22NCNE |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA316 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-316 |
| 文件頁數(shù)： | 62/145頁 |
| 文件大?。?/td> | 2285K |
| 代理商： | MT8LLN22NCNE |
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Coppertail Product Specification
MT8LLN22NCNE.fm – Rev. 1, Pub. 2/02
23
2002, Micron Technology Inc.
PRELIMINARY
MT8LLN22NCNE
COPPERTAIL
Status Register (Device 7h, Function 0h)
NOTE: 1. The Capabilities List enabled attribute is controlled by the capability disable bit (bit 30 of register 40h.) When
this bit is set the Capabilities list is disabled.
Revision ID (Device 7h, Function 0h)
6
Parity Error Checking Enable.
R/O
0
5
VGA Palette Snoop Enable.
R/O
0
4
Memory Write and Invalidate Enable.
R/W
0
3
Special Cycle Enable. When set, special cycles are monitored.
R/W
0
2
Bus Master Enable. When set, the device is bus master capable.
R/W
0
1
Memory Space Enable. When set, Memory accesses from PCI are enabled.
R/O
0
I/O Space Enable. When set, I/O accesses from PCI are enabled for the
SMB PCI target.
R/O
0
ADDRESS: 06h-07h
SYMBOL: STS
BITS
DESCRIPTION
PROPERTIES
RESET
NOTES
15
Parity Error Detected.
R/O
0
14
Signaled System Error. This bit is set when this device has
asserted SERR#.
R/WOTC
0
13
Signaled Master Abort.
R/O
0
12
Received Target Abort.
R/O
0
11
Signaled Target Abort.
R/O
0
10:9
DEVSEL# Timing (Medium timing).
R/O
01b
8
Data Parity Error Reported.
R/O
0
7
Fast Back-to-Back Capable.
R/O
0
6
User Definable Features Supported.
R/O
0
5
66 MHz Capable.
R/O
1
4
Capabilities flag.
R/O
1
3:0
Reserved.
R/O
0
ADDRESS: 08h
SYMBOL: RID
BITS
DESCRIPTION
PROPERTIES
RESET
7:0
Revision ID.
R/O
00h
Command Register (Device 7h, Function 0h) (continued)
ADDRESS: 04h-05h
SYMBOL: CMD
BITS
DESCRIPTION
PROPERTIES
RESET
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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