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參數(shù)資料
| 型號： | MT8LLN22NCNE |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA316 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-316 |
| 文件頁數(shù)： | 127/145頁 |
| 文件大?。?/td> | 2285K |
| 代理商： | MT8LLN22NCNE |
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Coppertail Product Specification
MT8LLN22NCNE.fm – Rev. 1, Pub. 2/02
82
2002, Micron Technology Inc.
PRELIMINARY
MT8LLN22NCNE
COPPERTAIL
Operational Control Word (OCW1)
1
Automatic EOI. Normally programmed to zero.
W/O
0
x86 architecture. Must be programmed to one.
W/O
0
ADDRESS: 21h
SYMBOL: OCW1
ADDRESS: A1h
MASTER CONTROLLER
SLAVE CONTROLLER
BITS
DESCRIPTION
PROPERTIES
RESET
7:0
Interrupt Request Mask. When a bit is set in this register, the correspond-
ing IRQ line is masked. When a bit is clear in the register, the correspond-
ing IRQ mask bit is cleared and interrupt requests will again be accepted.
Masking IRQ2 on the master controller will also mask the interrupt
requests from the slave controller. Writes to this register must follow the
entire initialization sequence.
R/W
FFh
Initialization Command Word 4 (continued)
ADDRESS: 21h
SYMBOL: ICW4
ADDRESS: A1h
MASTER CONTROLLER
SLAVE CONTROLLER
BITS
DESCRIPTION
PROPERTIES
RESET
Edge/Level Control Register
ADDRESS: 4D0h
SYMBOL: ELCR1, ELCR2
ADDRESS: 4D1h
MASTER CONTROLLER
SLAVE CONTROLLER
BITS
DESCRIPTION
PROPERTIES
RESET
7
IRQ15/7 Edge/Level mode.
0: Edge Triggered mode.
1: Level Triggered mode.
R/W
0
6
IRQ14/6 Edge/Level mode.
0: Edge Triggered mode.
1: Level Triggered mode.
R/W
0
5
IRQ5 Edge/Level mode.
0: Edge Triggered mode.
1: Level Triggered mode.
Must be programmed to 0 in slave controller.
R/W
0
4
IRQ12/4 Edge/Level mode.
0: Edge Triggered mode.
1: Level Triggered mode.
R/W
0
3
IRQ11/3 Edge/Level mode.
0: Edge Triggered mode.
1: Level Triggered mode.
R/W
0
2
IRQ10 Edge/Level mode.
0: Edge Triggered mode.
1: Level Triggered mode.
Must be programmed to 0 in master controller.
R/W
0
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PDF描述 |
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