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參數(shù)資料
| 型號： | MT8LLN22NCNE |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA316 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-316 |
| 文件頁數(shù)： | 14/145頁 |
| 文件大?。?/td> | 2285K |
| 代理商： | MT8LLN22NCNE |
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Coppertail Product Specification
MT8LLN22NCNE.fm – Rev. 1, Pub. 2/02
110
2002, Micron Technology Inc.
PRELIMINARY
MT8LLN22NCNE
COPPERTAIL
Primary General Purpose I/O Input Value
Primary General Purpose I/O Input Polarity Sense
Primary General Purpose I/O Output Value
Primary General Purpose I/O Output Enable
Primary General Purpose I/O Input Edge/Level Select
ADDRESS: ACPI_BASE + A4h
SYMBOL: PGPIO_IN_VAL
BITS
DESCRIPTION
PROPERTIES
RESET
15:0
GPIO_ VCORE [15:0] Input Value. Each bit represents the input value of
a corresponding GPIO_VCORE.
R/O
0
ADDRESS: ACPI_BASE + A6h
SYMBOL: PGPIO_POLSENS
BITS
DESCRIPTION
PROPERTIES
RESET
15:0
GPIO_ VCORE [15:0] Input polarity. When a bit corresponding to a
GPIO_VCORE is set, the GPIO_VCORE sense is active high. When a bit
corresponding to a GPIO_VCORE is clear, the GPIO_VCORE sense is
active low.
R/W
0
ADDRESS: ACPI_BASE + A8h
SYMBOL: PGPIO_IN_VAL
BITS
DESCRIPTION
PROPERTIES
RESET
15:0
GPIO_ VCORE [15:0] Output Value. Each bit represents the output
value of a corresponding GPIO_VCORE. This value will appear on the
GPIO_VCORE output pin when enabled.
R/W
0
ADDRESS: ACPI_BASE+ AAh
SYMBOL: PGPIO_OUT_EN
BITS
DESCRIPTION
PROPERTIES
RESET
15:0
GPIO_ VCORE [15:0] Output Enable. When a bit corresponding to a
GPIO_VCORE is set, the GPIO_VCORE output is enabled. When a bit
corresponding to a GPIO_VCORE is clear, the GPIO_VCORE output is
disabled.
R/W
0
ADDRESS: ACPI_BASE+ ACh
SYMBOL: PGPIO_IN_EL
BITS
DESCRIPTION
PROPERTIES
RESET
31:16
Reserved.
R/W
0
15:0
GPIO_VCORE[15:0] Edge/Level Sense. Each bit controls the edge/level
select of a corresponding GPIO_VCORE. When set, the GPIO_VCORE is
edge triggered. When clear, the GPIO_VCORE is level triggered.
R/W
0
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PDF描述 |
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