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參數(shù)資料
| 型號(hào)： | MT8LLN22NCNE |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA316 |
| 封裝： | 27 X 27 MM, PLASTIC, BGA-316 |
| 文件頁數(shù)： | 12/145頁 |
| 文件大小： | 2285K |
| 代理商： | MT8LLN22NCNE |
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Coppertail Product Specification
MT8LLN22NCNE.fm – Rev. 1, Pub. 2/02
109
2002, Micron Technology Inc.
PRELIMINARY
MT8LLN22NCNE
COPPERTAIL
Standby General Purpose I/O Output Enable
NOTE:
Register is standby powered and unaffected by SB_POWEROK or P_RST#. Reset only with RSMRST#.
Standby General Purpose I/O Input Edge/Level Select
NOTE:
Register is standby powered and unaffected by SB_POWEROK or P_RST#. Reset only with RSMRST#.
Standby General Purpose I/O Output Blink
NOTE:
Register is standby powered and unaffected by SB_POWEROK or P_RST#. Reset only with RSMRST#.
Primary General Purpose I/O Status
Primary General Purpose I/O Event Enable
ADDRESS: ACPI_BASE + 8Ah
SYMBOL: SGPIO_OUT_EN
BITS
DESCRIPTION
PROPERTIES
RESET
15:0
GPIO_VAUX[15:0] Output Enable. When a bit corresponding to a
GPIO_VAUX is set, the GPIO_VAUX output is enabled. When a bit corre-
sponding to a GPIO_VAUX is clear, the GPIO_VAUX output is
disabled.
R/W
0
ADDRESS: ACPI_BASE + 8Ch
SYMBOL: SGPIO_IN_EL
BITS
DESCRIPTION
PROPERTIES
RESET
15:0
GPIO_VAUX[15:0] Edge/Level Select. Each bit controls the edge/level
select of a corresponding GPIO_VAUX. When set, the GPIO_VAUX is edge
triggered. When clear, the GPIO_VAUX is level triggered.
R/W
0
ADDRESS: ACPI_BASE + 8Eh
SYMBOL: SGPIO_BLINK
BITS
DESCRIPTION
PROPERTIES
RESET
15:0
VAUX 1-Second Blink. When set a bit corresponding to GPIO_VAUX[15:0]
is set, the corresponding GPIO_VAUX will blink every second as measured
by RTC. When clear, no blinking will occur.
R/W
0
ADDRESS: ACPI_BASE + A0h
SYMBOL: PGPIO_STS
BITS
DESCRIPTION
PROPERTIES
RESET
15:0
GPIO_VCORE [15:0] Status. When a bit corresponding to a GPIO_VCORE is
set, the GPIO_VCORE event has occurred.
R/WOTC
0
ADDRESS: ACPI_BASE + A2h
SYMBOL: PGPIO_EVT_EN
BITS
DESCRIPTION
PROPERTIES
RESET
15:0
GPIO_VCORE [15:0] Event Enable. When a bit corresponding to a
GPIO_VCORE is set, the GPIO_VCORE event is enabled and will set
GPSTS0 bit 9. When a bit corresponding to a GPIO_VCORE is clear, the
GPIO_VCORE event is disabled.
R/W
0
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