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參數(shù)資料
| 型號： | IBM21P100BGC |
| 元件分類： | 總線控制器 |
| 英文描述： | PCI BUS CONTROLLER, PBGA304 |
| 封裝： | 31 X 31 MM, PLASTIC, BGA-304 |
| 文件頁數(shù)： | 115/144頁 |
| 文件大?。?/td> | 5197K |
| 代理商： | IBM21P100BGC |
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IBM21P100BGC
IBM 133 PCI-X Bridge R2.0
Configuration Registers
Page 72 of 144
ppb20_pcix_regs.fm.01
October 15, 2001
5.2.5.6 Arbiter Priority Register
This register indicates whether high or low priority is assigned to the corresponding request of the internal
secondary bus arbitration logic on the bridge.
Address Offset
x‘58’
Access
Read/Write
Reset Value
x‘01’
Re
s
e
rv
e
d
A
rbi
te
r
P
ri
or
it
y
6
A
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5
A
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4
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3
A
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A
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y
1
A
rbi
te
r
P
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it
y
0
7
6
5
4
3
2
1
0
Bit(s)
Access
Field Name and Description
7
RO
Reserved
6
RW
Arbiter Priority 6
0
Low priority request.
1
High priority request.
5
RW
Arbiter Priority 5
0
Low priority request.
1
High priority request.
4
RW
Arbiter Priority 4
0
Low priority request.
1
High priority request.
3
RW
Arbiter Priority 3
0
Low priority request.
1
High priority request.
2
RW
Arbiter Priority 2
0
Low priority request.
1
High priority request.
1
RW
Arbiter Priority 1
0
Low priority request.
1
High priority request.
0
RW
Arbiter Priority 0
This bit indicates the priority for the internal bridge requests.
0
Low priority request.
1
High priority request.
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PDF描述 |
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