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參數資料
| 型號： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網絡的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動柜員機分段和重組（SAR）的網絡應用（用于優(yōu)化網絡的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數： | 93/232頁 |
| 文件大?。?/td> | 1389K |
| 代理商： | L64360 |
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Misaligned Operations
8-13
the SAR-SDU in the VCR, using as many data structures as required to fill
out the body of the cell and without regard to data structure alignment,
before asking for a CRC32 calculation.
Once the SAR-SDU has been constructed in the VCR, the CRC32 Partial
(or Final) Result is calculated by initiating a DMA Ghost Write operation
to an arbitrary address. The DMA Ghost Write operation acts internally
like a memory write operation. The DMAC performs a Ghost Write oper-
ation, internal to the ATMizer Architecture, at a rate of one word/cycle.
Once the operation has completed, the CRC32 value can be read from the
CRC32RegisterthesameasinanyAAL5DMASegmentationprocedure.
Since the CRC32 Generator works on aligned data (data after it passes
throughtheDMACbytealigners),futurecellsbuiltfromthefinalCS-PDU
fragment do not require Ghost operations. CRC32 generation proceeds
smoothly as long as another unaligned boundary condition is not
encountered.
On reassembly operations, if header stripping and data field alignment is
employedforapplicationacceleration,thesameissuesmayarisewithcells
that contain the end of one header and the data field of a packet. On reas-
sembly, the CRC32 Generator works on VCR data before it reaches the
data aligners. Therefore, after the Ghost operation is done to generate the
CRC32 for the transition cell, future operations to a single fragment need
not utilize Ghost operations because the SAR-SDU is word aligned in the
VCR,eventhoughitmaynotbewordalignedafterbeingwrittenintomain
memory. The CRC32 Generator uses data aligned to its VCR destination,
not the main memory, in both directions.
All the incoming and outgoing cells are stored right-aligned in the VCR.
FortheDMAControllertoperforminthestandardmanner,theVCR/Main
Memory Starting Address Offset and Byte Count must be one of the com-
binations shown in
Table 8.5
.
Table 8.5
Starting Address
Offset and Byte
Count
Address Offset
Byte Count
0x0
0x1
0x2
0x3
0x0
:
64
63
62
61
60
:
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PDF描述 |
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