- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64360 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號(hào)： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動(dòng)柜員機(jī)分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁數(shù)： | 77/232頁 |
| 文件大?。?/td> | 1389K |
| 代理商： | L64360 |
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Cell Rate Pacing
7-7
CS-PDUs are attached to a PRPC by the Host Processor. When the Host
passes a Segment CS-PDU information packet to the ATMizer Architec-
ture, it includes in the information packet an indication of which PRPC
should be used to define the Service Interval for segmenting the CS-PDU.
It also includes the Burst Length value for the CS-PDU (how many cells
should be generated and sent, back-to-back, for the CS-PDU at each ser-
vice interval). The ATMizer Architecture, upon receiving this Segment
CS-PDUinformationpacket(throughHost-ATMizerMessaging)appends
the Channel Parameters for the CS-PDU to the end of the specified Chan-
nel Group and begins the segmentation process on the CS-PDU the next
time its associated PRPC times-out.
When servicing a Channel Group, APU firmware can generate and send
one or more cells for one VC before servicing the next VC in the Channel
Group. The number of cells to be sent before proceeding to the next Chan-
nel Group entry can be defined either by construction (this value is the
same for each member of a Channel Group and embedded into the firm-
ware directly) or by a field inside the Channel Parameter Entry for the VC.
Firmware running on the ATMizer Architecture segments the number of
cells specified by this Burst Length value before proceeding to the next
Channel Group entry. A side effect of this process is that the amount of
time required to access and restore a Channel Parameter Entry can be
amortized over several cells, effectively reducing the number of APU
instructions and the amount of time required to generate a cell. This time
savings may be of importance in high-speed applications (155 Mbits/s)
supporting a large number of VCs (more than 512).
Average Pacing
Average Pacing may not be implemented by the ATMizer Architecture. It
will probably be implemented by the Host Processor, which has access to
a realtime clock.
To maintain the Average Pacing Rate agreed to at connection establish-
ment, the Host Processor keeps a running total of the number of bytes sent
over each established VC. Prior to queuing a new CS-PDU for segmenta-
tion over a given VC, the Host Processor must first determine if queuing
theCS-PDUwouldviolatetheAverageRatefortheVC.Todothisthepro-
cessor calculates the amount of time that has passed since the last check-
point. It then divides the total number of bytes sent out over the VC since
the last checkpoint by the elapsed time. The result is the actual Average
Pacing Rate in bytes per second. If queuing the next CS-PDU would result
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