- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377598 > L64360 (LSI Corporation) Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) PDF資料下載
參數(shù)資料
| 型號(hào)： | L64360 |
| 廠商： | LSI Corporation |
| 英文描述： | Highly Integrated ATM Segmentation and Reassembly (SAR) Engine optimized for internetworking applications(用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片) |
| 中文描述： | 高度集成的自動(dòng)柜員機(jī)分段和重組（SAR）的網(wǎng)絡(luò)應(yīng)用（用于優(yōu)化網(wǎng)絡(luò)的高度集成的異步傳輸模式-分段和重組處理芯片優(yōu)化引擎） |
| 文件頁(yè)數(shù)： | 37/232頁(yè) |
| 文件大?。?/td> | 1389K |
| 代理商： | L64360 |
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ACI Receiver
3-7
TX_RST
Transmitter Reset
Asserting TX_RST resets the Physical Layer. After the L64360
is powered on, the L64360 asserts TX_RST LOW within two to
four cycles of the L64360 System Clock. TX_RST is deasserted
two clock cycles after the Transmit Initialize Bit in the System
Control Register is set to one. After a system reset, the L64360
drives TX_RST LOW.
Output
3.4
ACI Receiver
These signals receive ATM cell data and control ATM cell data reception.
For more information see
Chapter 9
.
HEC_ERR
HEC Error
The L64360 asserts HEC_ERR HIGH when the HEC Field that
is received (Byte 5 of a cell) does not equal the HEC Field that
theL64360calculatedfromtheATMHeader.HEC_ERRisonly
active when the receiver is configured to accept and check the
HEC byte. After a system reset, the L64360 drives HEC_ERR
LOW.
Output
RC_ACK
ACI Receiver Data Acknowledgment
Asserting RC_ACK HIGH indicates that valid data has been
placed on RC_D[7:0]. Framing logic in the transmission conver-
genceunitshouldassertRC_ACKHIGHwhenithasplaceddata
on RC_D[7:0]. The L64360 responds to RC_ACK by sampling
RC_D[7:0] on the rising edge of RC_CLK. The ACI Receiver
can be gapped by deasserting RC_ACK if external logic is
unable to supply a byte on RC_D[7:0] in a given cycle.
Input
RC_BOC
ACI Receiver Beginning of Cell
Asserting RC_BOC HIGH signals the beginning of a cell to the
ACI Receiver. When the Physical Layer asserts RC_BOC, the
ACIReceiverstartsacountertocountthenumberofbytesinthe
incoming cell.
Input
RC_CLK
ACI Receiver Clock
All receive signals are sourced or sampled on the rising edge of
this clock. RC_CLK drives the buffer inside the ATM Cell Inter-
face Receiver. All data transfers over RC_D[7:0] to the L64360,
as well as the assertion of all output signals, are synchronized to
RC_CLK. Logic inside of the L64360 handles synchronization
between the L64360 System Clock and the ACI Receive Data
Buffer circuitry powered by RC_CLK. The system designer
need not worry about metastability at the Receiver input.
RC_CLK is likely to be the clock derived from the line data and
Input
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